NJW1300A寄存器传输语言,试说明下列寄存器传输语言所描述的功能

试用寄存器传输语言描述题所描述的数字系统的传输操作。

画出系统的状态转换图。

用Verilog HDL描述其工作过程。(提示:数字锁系统的示意图如图题所示,由于开锁过程比较简单,所以没有划分控制单元和处理单元。LO、zi、I2用于低位到高位设置密码,另外三个输人端Re、EⅡ、胞中,Re是复位端,当Re=1时,系统复位进人初始状态。E7是控制开关,Kj是数据输人端,当按一下En键En=1时,从K0端输人一个数码,再按一下En键,再送一个数码,直到将三个数码送完为止。每输人一个数据都要同原设定的密码比较,依次从低位到高位。若相等则准各接收下一位数码,若不相等系统应进人错误状态。输人数码的位数也是开锁的条件。当输人数码的位数和位值与相应密码都相等时,系统发出开锁信号,yn=1,锁被打开,否则,Er表示开锁过程错误。初态,直到三个数码全部送完为止。)

为保密起见,中间错误状态不显示,并且不能返回开始时R键使跑表为零初始状态。在R键无效的时候,按一下S键则计时器开始计时,在此计时状态下,按一下s键暂停计时,再按一下s键则继续计时,并且这一过程可由S键控制重复进行。如果在暂停状态按一下R键,跑表被清零。

如果在计时状态下,按一下R键则暂停计时,再按一下R键则继续计时,并且这一过程也。f由R键控制重复进行,当按R键使计时暂停时,再按s键不起作用。要求跑表的计时范围为0.01s~59 min 59.99s,计时精度为10 ms;跑表的输出能够直接驱动共阳极7段数码管显示ˇ输人信号的频率为100 hz.

画出跑表的结构框图。

画出控制单元的ASM图及状态图。

用VcrilogIDL描述跑表的功能。

设P=3Ⅰ-y(X和y均为不带符号的二进制数)。若P=0,将y送到寄存器C中。否则将寄存器C清零。试用RTL表达该系统的工作。

用可编程逻辑器件实现数字系统,设计一个可以控制计数功能的计数器,当X=0时,计数器以二进制数序列000、001、010、011、100、101、110、111计数并重复。当X=1时,计数器以格雷码序列000、001、011、010、110、111、101、100计数并重复,要求:

画出计数器的状态图和ASM图.

用Ⅴenlog HDL描述系统的工作过程。

设计一个简单的3位二进制数字密码锁,控制房门的打开,当接收到的串行输人数码与原设定的密码相同时,发出开锁信号,锁被打开。要求:画出系统的ASM图。

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