2.5 VOLT HIGH -SPEED TeraSync FIFO
IDT72T1845 , IDT72T1855
18位/ 9位配置
IDT72T1865 , IDT72T1875
2,048 x 18/4,096 x 9, 4,096 x 18/8,192 x 9, 8,192 x 18/16,384 x 9,
IDT72T1885 , IDT72T1895
16,384 x 18/32,768 x 9, 32,768 x 18/65,536 x 9, 65,536 x 18/131,072 x 9,
IDT72T18105 , IDT72T18115
131,072 x 18/262,144 x 9, 262,144 x 18/524,288 x 9, 524,288 x 18/1,048,576 x 9
IDT72T18125
产品特点:
请选择以下内存组织之间:
IDT72T1845
2,048 x 18/4,096 x 9
IDT72T1855
4,096 x 18/8,192 x 9
IDT72T1865
8,192 x 18/16,384 x 9
IDT72T1875
16,384 x 18/32,768 x 9
IDT72T1885
32,768 x 18/65,536 x 9
IDT72T1895
65,536 x 18/131,072 x 9
IDT72T18105
131,072 x 18/262,144 x 9
IDT72T18115
262,144 x 18/524,288 x 9
IDT72T18125
524,288 x 18/1,048,576 x 9
截至时钟225 MHz工作
用户可选择HSTL / LVTTL输入和/或输出
阅读启用&读时钟输出回波援助高速运转
用户可选的异步读取和/或写入端口时序
2.5V LVTTL或1.8V , 1.5V HSTL端口可选的输入/输出继电器电压
3.3V输入宽容
马克&转发,复位读指针,以用户标记的位置
写片选( WCS )输入使能/禁止写操作
读片选( RCS )的同步,以RCLK
可编程几乎空和几乎全部的标志,每个标志可
默认为8个预选偏移1
程序可编程标志由串行或并行方式
可选的同步/异步时序模式Almost-
空的,几乎全旗
单独的输入SCLK为标志偏移串行编程
用户可选的输入和输出端口,总线上浆
- X9到了X9
- X9在以X18出
- X18中出X9
- X18到X18出
大端/小端用户选择字节表示
自动关机最大限度地降低待机功耗
主复位清除整个FIFO
部分复位清除数据,但保留可编程设置
空,满和半满标志信号FIFO状态
选择IDT标准时间(使用
EF
和
FF
标志) ,或第一个字
砸锅时间(使用
OR
和
IR
标志)
输出使能卖出期权数据输出为高阻抗状态
JTAG端口,提供边界扫描功能
可提供144引脚(13毫米X 13毫米)或240针( 19毫米x100 19毫米)
PlasticBall栅阵列( PBGA )
在深度和宽度易于扩展
独立的读写时钟(允许读取和写入
同时进行)
高性能的亚微米CMOS技术
工业级温度范围( ? 40 ° C至+ 85°C ),可
°
°
功能框图
D
0
-D
n
( X18或X9 )
文
WCLK / WR
WCS
LD
SEN
SCLK
输入寄存器
偏移寄存器
FF / IR
PAF
EF /或
PAE
HF
FWFT / SI
PFM
FSEL0
FSEL1
ASYW
写控制
逻辑
RAM阵列
2048 ×18或4096 ×9
4096 ×18或8192 ×9
8,192 ×18或16,384 ×9
16,384 ×18或32,768 ×9
32,768 ×18或65,536 ×9
65,536 ×18或131,072 ×9
131,072 ×18或262,144 ×9
262,144 ×18或524,288 ×9
524288 ×18或1,048,576 ×9
旗
逻辑
写指针
BE
IP
IW
OW
太太
PRS
TCK
TRST
TMS
TDO
TDI
VREF
WHSTL
RHSTL
SHSTL
控制
逻辑
公共汽车
CON组fi guration
RESET
逻辑
读指针
输出寄存器
读
控制
逻辑
RT
标志
ASYR
JTAG控制
(边界扫描)
RCLK / RD
任
RCS
HSTL I / 0
控制
OE
EREN
5909 drw01
Q
0
-Q
n
( X18或X9 )
ERCLK
IDT和IDT标识是注册为Integrated Device Technology ,Inc.的商标TeraSync FIFO是集成设备技术公司的商标。
商用和工业温度范围
1
2003集成设备技术, Inc.保留所有权利。产品规格如有变更,恕不另行通知。
2003年9月
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