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总线信号配时
这个建议特别适用于地址总线和数据总线。 6 “最大的PC走线长度
推荐使用。电容的计算应考虑所有设备的负载，以及寄生电容因
PC痕迹。注意合理的PCB布局和旁路成为具有较高的系统尤其重要
容性负载，因为这些负载创建在V高瞬态电流
DD
和GND电路。拉起所有未使用
输入或信号，就可以在复位期间输入。特别应注意尽量减少对噪声水平
PLL电源引脚。欲了解更多信息，请参见第14.4.3节，时钟合成器电源（ VDDSYN ，
VSSSYN ， VSSSYN1 ）所示，在
MPC866用户手册。
10总线信号配时
通过MPC866 / 859支持的最大总线速度为66兆赫。更高速的部分必须在操作
半速总线模式（例如，一个MPC866 / 859 ，在100 MHz的使用必须为50MHz的总线进行配置） 。
表7
和
表8
示出的频率范围为标准部分的频率。
表7.频率范围为标准件的频率（ 1 ：1的总线模式）
部分频率
民
CORE
40
50兆赫
最大
50
民
40
66兆赫
最大
66.67
公共汽车
40
50
40
66.67
表8.频率范围为标准件的频率（ 2 ：1的总线模式）
部分
频率
民
CORE
40
50兆赫
最大
50
民
40
66兆赫
最大
66.67
民
40
100兆赫
最大
100
民
40
133兆赫
最大
133.34
公共汽车
20
25
20
33.33
20
50
20
66.67
表9
显示/定时为MPC866 859在33 ， 40 ， 50 ，和66 MHz的总线操作。对于时机
MPC866 / 859在此表中显示总线假设一个50 pF负载的最大延迟和一个0 - pF负载最小
延误。 CLKOUT假设一个100 pF负载最大延时。
表9.总线操作时序
33兆赫
NUM
特征
民
B1
B1a
B1b
B1c
总线周期（ CLKOUT ）查看
表7
EXTCLK到CLKOUT相位偏移
CLKOUT频率抖动的峰 - 峰值
在EXTCLK频率抖动
—
–2
—
—
最大
—
+2
1
0.50
民
—
–2
—
—
最大
—
+2
1
0.50
民
—
–2
—
—
最大
—
+2
1
0.50
民
—
–2
—
—
最大
—
+2
1
0.50
ns
ns
ns
%
40 MHZ
50兆赫
66兆赫
单位
MPC866 / MPC859硬件规格，第2版
16
飞思卡尔半导体公司
