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系统设计信息
NV
DD
R
N
SW2
数据
PAD
SW1
R
P
V
SS
图60.驱动阻抗测量
这个电阻和驾驶员的电流源的强度的值可以通过使2中找到
测量。首先，将输出电压而驱动逻辑1而无需外部差分测量
端接电阻器。测得的电压为V
1
= R
来源
×
I
来源
。第二，输出电压被测量
而驱动逻辑1与R值的外部高精度差分端接电阻
TERM
。该
测得的电压为V
2
= (1/(1/R
1
+ 1/R
2
))
×
I
来源
。求解的输出阻抗给
来源
=
R
TERM
×
(V
1
/V
2
- 1） 。驱动电流是后来我
来源
= V
1
/R
来源
.
表72
总结了信号的阻抗目标。该驱动器阻抗是针对最小V
DD
,
标称NV
DD
, 105°C.
表72.阻抗特性
本地总线，以太网，
DUART ，控制
配置方面，电源
管理
42目标
42目标
NA
PCI信号
（不包括PCI
输出时钟）
25目标
25目标
NA
PCI时钟输出
（包括
PCI_SYNC_OUT ）
42目标
42目标
NA
阻抗
DDR DRAM
符号
单位
R
N
R
P
迪FF erential
20目标
20目标
NA
Z
0
Z
0
Z
差异
Ω
Ω
Ω
注意：
标称电源电压。看
表1
T
J
= 105°C.
22.7
配置复用管脚
该MPC8313E为用户提供了可通过使用设置上电配置选项
外部上拉或4.7 kΩ的上拉下拉电阻上的某些输出引脚（见顾客看得见
配置引脚） 。这些引脚通常用作输出只有在正常操作销。
虽然HRESET然而断言，这些引脚被视为输入。提出这两个引脚上的价值
而HRESET被断言，被锁存时PORESET拉高，在该时间输入接收器是
残疾人和I / O电路呈现其正常功能。与无存根连接精心的电路板布局
这些再加上拉/下拉电阻的值较大的上拉/下拉电阻应
最小的信号质量或速度为输出管脚的这样构成的破坏。
MPC8313E的PowerQUICC
II Pro处理器硬件规格，版本2.1
飞思卡尔半导体公司
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