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电气特性
表10. PLL电气特性（续）
NUM
12
13
特征
水晶容性负载
离散的负载电容的XTAL
离散的负载电容EXTAL
符号
C
L
C
L_XTAL
C
L_EXTAL
分钟。
价值
马克斯。
价值
单位
见晶体规格
—
2
×
(C
L
-
C
S_XTAL
-
C
S_EXTAL
-
C
S_PCB
)
6
4.0
2.0
10
待定
pF
14
15
17
频率未锁定范围
频率锁定范围
CLKOUT周期抖动，
3, 4, 7
在F量度
SYS
最大
峰 - 峰抖动（时钟边沿到时钟沿）
长期抖动
f
UL
f
LCK
C
抖动
-4.0
-2.0
—
—
% f
SYS
% f
SYS
％ FB_CLK
％ FB_CLK
1
2
3
4
5
6
7
最小系统频率是最小输入时钟的最大低功率分频器分频（16兆赫
÷
32,768).
当PLL被启用时，系统最低频率（f
SYS
）是150兆赫。
这个参数是由，而不是100 ％测试合格之前特性保证。适用于外部时钟
仅供参考。
正确的PC板布局过程必须遵循以实现特定连接的阳离子。
此参数由设计保证，而不是100 ％测试。
该规范只是PLL锁定时间，不包括振荡器起振时间。
C
S_PCB
是EXTAL和XTAL被测PCB的寄生电容。
抖动是从编程的频率测量是在最大f显示特定网络版的时间间隔平均偏差
SYS
.
测量是与设备搭载网络过滤的供应和稳定的外部时钟信号作为时钟源。噪音
注入通过PLL V的PLL电路
DD
， EV
DD
和V
SS
和变化的晶体振荡器的频率增加Cjitter
百分比为一个给定的时间间隔。
5.6
复位时序特定网络阳离子
表11
列出规格所示的复位时序参数
网络连接gure 8 。
表11.复位和配置取代时序
NUM
R1
1
R2
R3
R4
R5
R6
R7
R8
1
2
特征
RESET有效到CLKIN （设置）
CLKIN到RESET无效（保持）
复位有效时间
2
CLKIN到RSTOUT有效
RSTOUT有效配置来覆盖输入有效
配置取代输入有效到无效RSTOUT （设置）
后RSTOUT无效（保持）配置取代无效的输入
RSTOUT无效配置覆盖输入阻抗高
民
9
1.5
5
—
0
20
0
—
最大
—
—
—
10
—
—
—
1
单位
ns
ns
个CLKIN周期
ns
ns
个CLKIN周期
ns
个CLKIN周期
复位和配置覆盖数据线内部同步。建立和保持时间必须满足仅当
识别在特定的时钟是必需的。
在低功耗停止，同步器的复位输入被旁路，复位有效异步
到系统中。因此， RESET必须保持至少为100 ns 。
MCF5445x的ColdFire
微处理器数据手册，第3
22
飞思卡尔半导体公司
