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功能性器件操作
逻辑命令和寄存器
用户启动的消息通过SPI接口写入（
从MCU ）数据寄存器（ DNL）的低字节。
当9- 16位消息要发送时，用户写入
在DNH先注册，然后在黑暗与光明寄存器前
合并的9至16位的数据值DNH ：黑暗与光明上发送的
DBUS 。用户应该首先检查TFNFn状态标志
可以肯定的发送FIFO未满写入新的数据之前，
值到DNH和/或黑暗与光明。当最小帧间
延时已经满足， DSIF终端将变低，
指示新的传输帧的开始。
DBUS驱动器/接收器的通信涉及到的帧
（ DSIF ） ，数据信号（ DSIS ） ，和一个数据返回（ DSIR ）信号。
这些信号在IC内部带有相关
prData移出DSIS的（ MSB在前），并转移到DSIR
同时。当接收到一个消息时，它被存储比特
由位到下一个可用的接收FIFO中的位置。对于每一个
在接收FIFO数据值，存在一比特的状态标志
以指示是否有CRC错误，而
接收到该数据。在一个DBUS传送结束（与后
CRC校验错误状态是稳定的） ，在RFNEn标志设置（如果它是
没有的话） ，以指示有一个在接收FIFO中的数据是
读取。
对于其它的时钟频率，数据速率可以是
使用下面的公式计算：
数据传输率= （F
CLK
/ 33） *（1 + OFFSET / 512）
CRC生成/检查
每当一个消息被发送的DBUS ，一个0-到8位
CRC值的计算和串行发送作为下一个n位
后的LSB数据。在CRC的长度，多项式，并
初始种子是由CRCLEN测定[3： 0]，
CRCPOLY [7： 0]，和CRCSEED [7：0 ]控制寄存器字段。
的消息，其中包括CRC位，沿一个通过
远程外围，它计算出一个单独的CRC值
该信息数据被接收。如果计算出的CRC不
同意的消息中接收到的CRC值，该
外围设备认为该消息无效。
收到的消息包含0 8位CRC值，
被计算的是响应所述外围设备。如
收到消息，一个独立的0 8位CRC值
计算，并与在所述的CRC值进行比较
接收到的消息。如果这些值不同意，该消息
被认为是无效的，并在D01STAT的ERn与状态位
寄存器被设置为被传输至所述接收数据
接收数据缓冲器。
当没有遥控外围设备响应消息，所述
收到的将是为0的CRC值全零数据模式，
这可以被检测为根据CRC错误
CRCLEN [3：0 ]的值， CRCPOLY [7：0 ] ，并
CRCSEED [7：0 ] 。另一方面，如果一个远程外设
连接并响应与一个CRC值全部为零
1010，这可以被检测为一个非错误条件。
数据速率
在非扩频模式中，数据速率确定
由系统时钟（CLK）和可编程时钟
分频器。 （时钟分频比
n
中定义
表10. ）
数据速率= F
CLK
/ (27 * n)
在扩频模式中，数据速率由下式确定
系统时钟（ CLK）和DnOFFSETL / H寄存器
编程。需要注意的可编程时钟分频器不
控制在扩频模式的数据速率。请参阅
寄存器和位说明
一节。
下表给出之间的对应关系
偏移量和数据速率对于f
CLK
= 4.0兆赫。
表7.数据速率随偏移（扩频）
OFFSET
（十六进制）
00
3F
7A
9F
DEC
0
63
122
159
数据速率
千赫
121.2
136.1
150.1
158.9
CRC计算
CRC算法使用一个可编程的初始化
值，或种子， CRCSEED [7 ：0]和一个可编程
CRCPOLY的多项式[7：0 ] 。
图16
是VHDL
在CRC算法描述为DBUS标准的4位
CRC与1010的初始值的种子值的选取要
一个零数据值将产生1010的CRC值
默认的CRC计算的方框图中示出
图17 。
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模拟集成电路设备数据
飞思卡尔半导体公司
