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DDR SDRAM
(Rev.1.44)
三月'02
读
三菱的LSI
M2S56D20 / 30 / 40ATP -75AL ， -75A ， -75L ， -75 ， -10L ， -10
M2S56D20 / 30 / 40AKT -75AL ， -75A ， -75L ， -75 ， -10L ， -10
256M双数据速率同步DRAM
从该库激活的tRCD后， READ命令可以被发出。第一个输出数据后可用
/ CAS延时从读取，此后（ BL-1 ）个连续的数据。 （ BL ：突发长度）的起始地址是
由A11指定的，A9 -A0 （×4 ） / A9 -A0的（x8） / A8 -A0 （ ×16） ，和脉冲串数据的地址序列由定义
突发类型。读命令，可以发给任何有效的银行，因此该行预充电时间（TRP）可
期间交织的多重银行连续突发数据隐藏。当A10是高READ
命令时，自动预充电（ READA ）被执行。任何命令（读，写， PRE ， ACT ）断言
同一家银行被禁止，直到内部预充电完成。内部预充电操作开始于
READA命令后， BL / 2的时间。接下来的ACT命令后（ BL / 2 + tRP）内从时间发出
以前READA 。
多行交错READ （ BL = 8 ， CL = 2 ）
/ CLK
CLK
命令
A0-9,11
A10
BA0,1
的DQ
DQ
/ CAS延时
QA0 QA1 QA2 QA3
QA4 QA5
QA6 QA7 QB0 QB1
QB2 QB3 QB4 QB5
QB7 QB8
法案
tRCD的
Xa
Xa
00
读ACT
Y
0
00
Xb
Xb
10
读预
Y
0
10
0
00
突发长度
三菱电机
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