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特定网络阳离子
3.9.2.8等待写周期DMA启用
5
地址
1
CS5
可编程
最小为0ns
可编程
最小为0ns
3
10
2
EB
11
7
RW
4
OE （高电平）
等待
6
12
9
数据总线
（输出到i.MX ）
13
8
图13.等待写周期DMA启用
表20.等待写周期DMA启用： WSC = 111111 ， DTACK_SEL = 1 ， HCLK = 96MHz的
3.0 ± 0.3 V
数
1
2
3
4
5
6
7
8
9
10
11
12
13
特征
最低
CS5断言时间
EB断言时间
CS5脉冲宽度
RW否定前CS5被否定
地址灭活CS否定后
等待断言后CS5断言
等待断言RW否定
后RW否定数据保持时间
数据准备CS5后置
CS去激活下一个CS活跃
CS否定后EB否定
等待变低后CS5断言
等待脉冲宽度
见注2
见注2
3T
2.5T-3.63
–
–
T+2.66
2T+0.03
–
T
0.5T
0
1T
最大
–
–
–
2.5T-1.16
0.09
1020T
2T+7.96
–
T
–
0.5T+0.5
1019T
1020T
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
单位
注意：
1， T是系统时钟周期。 （ 96 MHz系统时钟，T = 10.42纳秒）
2. CS5断言可以通过CSA位来控制。 EB断言也可以是可编程通过WEA位CS5L寄存器。
3.地址变为有效和RW断言在写存取周期的开始。
当CS5被编程为使用内部等待状态4，外部等待输入的要求被淘汰。
MC9328MXS超前信息，牧师0
26
飞思卡尔半导体公司
