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AFE7222
AFE7225
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SLOS711B - 2011年11月 - 修订2012年3月
差分时钟缓冲器
Lpkg
≤ 1 nH的
20
W
CEQ
RESR
~100
W
CLKINP
Cbond
= 1 pF的
CEQ
5千瓦
VCM
2 pF的
5千瓦
Lpkg
≤ 1 nH的
20
W
CLKINN
Cbond
= 1 pF的
RESR
~100
W
碳当量 1 3 pF的，差的等效输入电容
时钟缓冲器
图10-14 。输入时钟等效电路
10.8辅助ADC
辅助ADC的示意图如下所示。
MODE_INPUT<1 ： 0>
BYPASSZ_BUF
AUXADC_A
S高
输入
卜FF器
AUXADC_B
12-Bit
SAR ADC
串行器
SDOUT
SCLK
SCLK
图10-15 。辅助ADC原理图
所述辅助ADC包括一个12位SAR ADC与由旁路高阻抗输入缓冲器
默认（ BYPASSZ_BUF = 0）。辅助ADC可以从2个外部引脚选择叫其输入
AUXADC_A和AUXADC_B 。这种选择是通过使用比特MODE_INPUT <1 ： 0> 。转换
由位CONV_START设置为1，开始，和SCLK被用作转换时钟。该SAR ADC
将所选择的输入和12位输出使用SCLK序列和给定列于
SDOUT引脚。设置CONV_START为1后，辅助ADC可针对单个配置
转换，多次转换或连续转换模式。
与旁路输入缓冲器，辅助ADC的输入范围是0-1.5V时RANGE_AUXADC是
设置为0。当辅助ADC的转换，在SAR ADC抽奖切换的输入引脚，如果电流
输入缓冲器被旁路。这可能是不期望的应用程序，其中被监视的电压
不具备驱动能力。与输入的，所述AUXADC路径引入的输入缓冲器
输入是高阻抗，没有拉电流。然而，输入电压范围（在AUXADC
引脚）被小幅下调至0.1-1.5V 。
与RANGE_AUXADC设置为1时，输入范围增大至0 DVDD18与旁路缓冲器和
0.1- （ DVDD18-0.1 ） V配合缓冲器使能。
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