SG536
低EMI时钟发生器的多功能产品
批准的产品
产品特点
接线图
VDD
XIN
XOUT
VSS
CPUsel1
T
支持多时钟要求
T
T
T
T
T
集成了扩频
功能的产品配套打印机，
复印机，扫描仪，传真/调制解调器的集成。
CPU的可编程时钟输出。
从3.3V或5V电源供电
60毫安缓冲开关电流
16引脚SOIC最小的电路板空间
技术用于EMI衰减最多的
15分贝谐波频率。
该IMISG536是一个集成了时钟发生器
对于多功能产品时钟要求
或独立的产品，如打印机，复印机，
和扫描仪。
此外，它集成了
频谱扩频技术，调制
技术专为降低EMI设计
在基频，并在其
谐波。所述EMI衰减正比于
的频率，因此，实现更大的
减少在那里它是多个谐波
很难通过联邦法规的辐射
排放量（例如FCC ， CSPIR等）。
该IMISG536从20 MHz的工作
在引脚2和3，或从一个晶体振荡器
外部时钟源。在REF输出为
缓冲输出的输入信号鑫。 CPUCLK
是所述调制输出的EMI衰减。这
时钟具有可选的输出频率从而可以
与CPUsel （ 1 0）中选择。
VIDclk （ 60兆赫）和SCNclk （ 40 MHz）的高度
准确固定的频率，因此，不
调制。
该器件采用16引脚SOIC
包最小占用的电路板空间。
CPUsel0
VSS
VDD
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
REF
CPUCLK
VSS
VDD
SCNCLK
VIDCLK
VSS
MODSEL
CPUCLK选型表
CPUsel1
0
0
1
1
CPUsel0
0
1
0
1
CPUCLK （兆赫）
16
33
25
50
框图
20兆赫
XIN
REF
XOUT
B
REF
CPUsel1
CPUsel0
MODSEL
PLL1
SSCG
控制
B
CPUCLK
PLL2
B
B
VIDCLK
SCNCLK
国际微电路， INC 。 525 LOS COCHES ST 。
MILPITAS ， CA 95035电话： 408-263-6300 。 FAX 408-263-6571
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引脚说明
OSCIN ， OSCOUT
- 这些引脚组成一个片上参考振荡器时，连接到外部并联终端
谐振晶体。 OSCIN也可以用作输入端，用于将外部产生的CMOS电平或AC耦合参考
信号。
CPUsel （0： 1）
- 输入控制用于选择CPUCLK输出的时钟频率引脚。见表1页这些
引脚具有内部上拉电阻。
MODSEL -
该引脚用于控制频谱扩展允许/禁止。当低，扩频不适用
到CPUCLK输出。当高（默认值） ，这个引脚使CPUCLK在其中心的+/- 1.25 ％调制
频率为如在图1中描述在图2中，第4页中描述，并降低了EMI它有一个内部上拉。
CPUCLK
- 可编程扩频时钟发生器调制时钟输出系统CPU 。频率可以根据第1页上的表中进行选择。
SCNclk -
非调制时钟输出，进行系统扫描处理。这是在40.00000 MHz的恰好居中。
VIDCLK
- 非调制时钟输出系统引擎的逻辑。这是在60.00000 MHz的恰好居中。
VDD
- 电路电源正极。
VSS
- 电路接地。
旁路电容（ 0.1μF ）应放置在尽可能靠近每个VDD引脚。如果这些旁路电容
不靠近引脚的高频滤波特性将引线电感被取消
的痕迹。
最大额定值
该器件包含电路，以保护输入
不受损坏，由于高静电压或电
场;然而，应采取预防措施，以避免
应用高于最大值的任何电压的
额定电压至该电路。为了正常工作，输入电压
和Vout的应被约束的范围内
VSS< （VIN或Vout）外部<VDD
未使用的输入必须始终连接到一个适当的
逻辑电压电平（ VSS或VDD） 。
电压相对于VSS ：
电压相对于VDD ：
存储温度：
环境温度：
最大电源：
-0.3V
0.3V
-65 ° C至+ 150°C
-55℃至+ 125℃
7V
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电气特性
特征
输入低电压
输入高电压
输入低，或高电流
与上拉或下拉
输出低电压
IOL = 12毫安
输出高电压
IOH = 12毫安
动态电源电流
静态电源电流
短路电流
符号
VIL
VIH
IIL ， IIH
VOL
VOH
ICC
icc的（PD）的
ISC
民
-
2.0
-
-
2.4
-
-
25
典型值
-
-
-
-
-
-
200
-
最大
0.8
-
66
0.4
-
40
-
-
单位
VDC
VDC
A
VDC
VDC
mA
A
mA
条件
CPUsel （0 ：1）， MODSEL
CPUsel （0 ：1）， MODSEL
CPUsel （0 ：1）， MODSEL
所有输出
所有输出
CPUCLK = 50 MHz的
-
1输出的时间 - 30秒
VDD = 5V ， TA = 0°C至+ 70°C
开关特性
特征
输出上升（ 0.4V - 2.0V ）
和秋季（ 2.0V - 0.4V ）时
输出占空比
ΔPeriod
相邻周期
中央处理器
绝对抖动
中央处理器
开关电流低*
开关电流高*
符号
tTLH ，
TTHL
-
P
Tjab
人工晶状体（AC）的
IOH （AC）的
民
-
45
-
-
-
-
60
60
典型值
-
50
-
最大
2
55
+250
500
-
-
单位
ns
%
ps
ps
mA
mA
条件
15 pF负载
测量1.5V
-
MODSEL = 0
VOL = 1.5V
VOL = 1.5V
VDD = 5V ， TA = 0°C至+ 70°C
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扩频
振幅
（ DB
)
与扩频
没有扩频
频谱分析
中心
频率（兆赫
)
调制域分析
调制方式
调制的
FOUT频率。
（兆赫）
时间
记
：调制速率，
FR ，
是依赖于输入频率（辛） 。
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PCB布局建议
威盛到地平面
IMISG536
1
C3
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
C5
C4
C8
22f
FB1
通过到VCC
注：旁路电容器C3，C4和C5 ，
（ 0.1μF ）应放在尽可能接近
可能每个VDD引脚。如果这些绕行
电容是不是靠近引脚的
高频滤波特性的意志
通过的铅电感被取消
痕迹。
笔记
1.电源旁路电容（ O.1UF ）必须是位置靠近VDD引脚是有效的。
2， C3 ， C4，C5 ，C和C8 CAPS必须是低漏电，如多层陶瓷Z5U或X7R材料。
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