B9948
3.3V ， 160兆赫， 1:12时钟分配缓冲器
特点
160 - MHz时钟支持
LVPECL或LVCMOS / LVTTL时钟输入
LVCMOS / LVTTL兼容输入
12时钟输出：驱动多达24时钟线
同步输出使能
输出三态控制
350 ps的最大输出至输出扭曲
引脚兼容MPC948
工业级温度范围。范围：-40 ° C至+ 85°C
32引脚TQFP封装
描述
所述B9948是与一个低电压时钟分配缓冲器
能力选择差分LVPECL或LVC-
MOS / LVTTL兼容的输入时钟。这两个时钟源
可以用来提供一种用于测试时钟以及主
系统时钟。所有其他的控制输入是LVCMOS / LVTTL
兼容。十二输出是3.3V LVCMOS或LVTTL
兼容，可驱动两个串联端接50Ω transmis-
锡永线。有了这个能力B9948具有有效的
扇出1:24 。的输出也可以是经由三态
三态输入TS ＃ 。低输出至输出歪曲率使
B9948嵌套时钟树的理想时钟分配缓冲区
在最苛刻的同步系统。
所述B9948还提供了一个同步输出使能输入
用于允许或禁止输出时钟。由于该输入
内部同步于输入时钟，电势输出
毛刺或欠幅脉冲产生被淘汰。
框图
引脚配置
VSS
Q0
VDDC
Q1
VSS
Q2
VDDC
Q3
VDD
PECL_CLK
PECL_CLK ＃
TCLK
TCLK_SEL
SYNC_OE
TS ＃
0
1
VDDC
12
Q0-Q11
TCLK_SEL
TCLK
PECL_CLK
PECL_CLK ＃
SYNC_OE
TS ＃
VDD
VSS
1
2
3
4
5
6
7
8
32
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
B9948
9
10
11
12
13
14
15
16
VSS
Q4
VDDC
Q5
VSS
Q6
VDDC
Q7
赛普拉斯半导体公司
文件编号： 38-07079牧师* D
3901北一街
圣荷西
Q11
VDDC
Q10
VSS
Q9
VDDC
Q8
VSS
CA 95134 408-943-2600
修订后的2002年12月14日
B9948
引脚说明
[[1]]
针
3
4
2
9, 11, 13, 15, 17, 19,
21, 23, 25, 27, 29,
31
1
5
名字
PECL_CLK
PECL_CLK ＃
TCLK
Q(11:0)
VDDC
PWR
I / O
我， PU
我， PD
我， PU
O
PECL输入时钟
PECL输入时钟
外部参考/测试时钟输入
时钟输出
描述
TCLK_SEL
SYNC_OE
我， PU
我， PU
时钟选择输入。
当低， PECL时钟选择
当高TCLK被选中。
输出使能输入。
当置为高电平时，输出
启用并设置时的低输出被禁止在低
状态。
三态控制输入。
当置为低电平时，输出
是三态缓冲器。当设定高时，输出缓冲器
被启用。
3.3V电源的输出时钟缓冲器
3.3V电源
共同点
6
TS ＃
我， PU
10, 14, 18, 22, 26,
30
7
8, 12, 16, 20, 24,
28, 32
VDDC
VDD
VSS
注意：
1， PD =内部下拉， PU =内部上拉电阻。
输出使能/禁用
所述B9948设有一个控制输入端，以使能或禁止
输出。该数据被锁存，输入的下降沿
时钟。当SYNC_OE为低电平时，输出显示
体健处于低状态。当SYNC_OE设为高电平时，输出
看跌期权被启用，如图
图1 。
TCLK
SYNC_OE
Q
图1. SYNC_OE时序图
文件编号： 38-07079牧师* D
第2 6
B9948
最大额定值
[2]
最大输入电压相对于V
SS
: ............ V
SS
– 0.3V
最大输入电压相对于V
DD
: ............. V
DD
+ 0.3V
存储温度： ................................- 65 ° C至+ 150°C
工作温度： .................................- 40 ° C至+ 85°C
最高ESD保护.............................................. 2 KV
最大电源： .............................................. ..5.5V
最大输入电流： .............................................. .... ±20 mA内
该器件包含电路，以保护输入对
损坏，由于高静电压或电场;不过，
应采取预防措施，以避免应用程序的任何电压的
年龄大于最大额定电压至该电路更高。为
正确的操作，V
in
和V
OUT
应限制到
范围：
V
SS
＆ LT ; （V
in
或V
OUT
） ＆ LT ; V
DD
未使用的输入必须始终连接到一个适当的逻辑电压
年龄层次（或V
SS
或V
DD
).
DC参数：
V
DDC
= 3.3V ±10%, V
DD
= 3.3V ±10 ％ ，T
A
= -40 ° C至+ 85°C
参数
V
IL
V
IH
I
IL
I
IH
V
PP
V
CMR
V
OL
V
OH
I
DD
C
in
描述
输入低电压
条件
PECL_CLK ，单端
所有其它输入
输入高电压
PECL_CLK ，单端
所有其它输入
低输入电流（ @V
IL
= V
SS
)
输入大电流（ @V
IL
=V
DD
)
峰 - 峰值输入电压
PECL_CLK
共模范围PECL_CLK
输出低电压
输出高电压
静态电源电流
输入电容
I
OL
= 20 mA时，注[ 5 ]
I
OH
= -20毫安，V
DDC
= 3.3V ，注[ 5 ]
所有V
DDC
和V
DD
2.5
1
2
4
注[4]
300
V
DD
– 2.0
注[3]
分钟。
1.49
V
SS
2.135
2.0
典型值。
马克斯。
1.825
0.8
2.42
V
DD
–100
100
1000
V
DD
– 0.6
0.4
A
A
mV
V
V
V
mA
pF
V
单位
V
注意事项：
2.
多个电源：
对任何输入或I / O引脚上的电压不能超过电期间的电源引脚。电源定序不要求
3.输入有上拉电阻的影响输入电流， PECL_CLK ＃有一个下拉电阻。
4. V
CMR
从差分输入信号的最正侧的差。当“高”输入是V内获得正常操作
CMR
范围和输入在于内伏
PP
特定连接的阳离子。
5.驾驶串联或并联端接50Ω （或50Ω到V
DD
/ 2）的传输线。
文件编号： 38-07079牧师* D
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B9948
AC参数
[[6]]
:
V
DDC
= 3.3V ±10%, V
DD
= 3.3V ±10 ％ ，T
A
= -40 ° C至+ 85°C
参数
FMAX
tPD的
描述
最大输入频率
[[7]]
PECL_CLK到Q延迟
[[7]]
TCLK到Q延迟
[[7]]
FoutDC
tpZL ， tpZH
tpLZ ， tpHZ
TSKEW
Tskew （页）
输出占空比
[[7],[8]]
输出使能时间（所有输出）
输出禁止时间（所有输出）
输出至输出扭曲
[[7],[9]]
部分到部分斜
[[10]]
建立时间
[[7],[11]]
保持时间
[[7],[11]]
输出时钟的上升/下降时间
[[9]]
PECL_CLK到Q
TCLK到Q
Ts
SYNC_OE到PECL_CLK
SYNC_OE到TCLK
Th
PECL_CLK到SYNC_OE
TCLK到SYNC_OE
TR / TF
0.8V至2.0V
1.0
0.0
0.0
1.0
0.2
1.0
ns
ns
测量V
DDC
/2
条件
分钟。
160
4.0
4.4
TCYCLE / 2 - 800
2
2
8.0
8.9
TCYCLE / 2 + 800
10
10
350
1.5
2.0
ns
ps
ns
ns
ps
ns
典型值。
马克斯。
单位
兆赫
ns
注意事项：
6.参数由设计和特性保证。不是100 ％生产测试。与负载输出指定的所有参数。
7.输出驱动50Ω的传输线。
8. 50％的输入的占空比。
9.输出满载每30 pF的。
10.第一部分到第二部分斜交在给定的温度和电压。
11.建立时间和保持时间是相对于输入时钟的下降沿。
订购信息
产品型号
IMIB9948CA
IMIB9948CAT
32引脚TQFP
32引脚TQFP - 带和卷轴
套餐类型
生产流程
工业， -40 ° C至+ 85°C
工业， -40 ° C至+ 85°C
注：订购型号是由设备号，设备版本，包装样式的组合形成，并作为筛选
如下所示。
标记：例如：
IMI
B9948CA
日期代码，批号＃
IMI B9948CA
包
A = TQFP
调整
设备号
文件编号： 38-07079牧师* D
第4 6
B9948
封装图纸和尺寸
32引脚超薄塑料四方扁平7 ×7× 1.0毫米A32
51-85063-B
本文档中提及的所有产品和公司名称可能是其各自所有者的商标。
文件编号： 38-07079牧师* D
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