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F28M35H20B1 , F28M35H20C1
F28M35H22B1 , F28M35H22C1 , F28M35H32B1 , F28M35H32C1
F28M35H50B1 , F28M35H50C1 , F28M35H52B1 , F28M35H52C1
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SPRS742D - 2011年6月 - 修订2012年8月
模拟子系统具有可访问ADC1 , ADC2和模拟比较器外设
通过模拟通用接口总线。 ADC结果寄存器是由CPU的访问,
法师和控制子系统的DMA 。所有其他模拟外设寄存器都被访问
C28x的CPU而已。在Cortex -M3 CPU访问ACIB通过系统总线和μDMA
通过μDMA总线。该ACIB仲裁访问ADC和模拟比较器寄存器
之间的主站子系统的CPU / DMA总线周期与控制子系统。此外
在管理总线周期中, ACIB也传送结束转换的ADC中断法师
子系统(以及到控制子系统) 。从ADC1八平机会的来源和八个EOC
从ADC2的来源是与同校一起由ACIB ,用得到的8 ADC的中断要
目的地在两个主子系统和控制子系统。
SEE
第6.1节
对共享资源和模拟外设的更多信息。
2.4
控制子系统
控制子系统包含的C28x CPU / FPU / VCU ,外设中断扩展( PIE )块,
DMA , C28x的外设,以及本地内存。此外,于C28x CPU和DMA访问共享
资源: IPC (仅CPU ) ,内存信息,并共享内存;并通过模拟模拟外设
通用接口总线。
图2-2
显示控制子系统。
2.4.1
的C28x CPU / FPU / VCU
该F28M35x协奏曲MCU系列是TMS320C2000 MCU平台中的一员。该
协奏曲的C28x CPU / FPU具有相同的32位定点架构TI现有的Piccolo 微控制器,
结合一个单精度( 32位)的IEEE 754浮点单元(FPU) TI现有德尔菲诺的
微控制器。每个F28M35x设备是一个非常高效的C / C ++引擎,使用户能够开发自己的系统
控制软件中的一个高级语言。每个F28M35x装置还使数学算法是
使用C / C ++开发。该设备同样高效的DSP数学任务和系统控制任务。
的32 ×32位MAC 64位处理能力使得控制器能够处理更高的数值
解决问题的效率。加上自动上下文保存的快速中断响应
关键寄存器的,该装置是能够服务于以最小的延迟许多异步事件。
该器件具有一个8级深的管道保护与流水线存储器访问。这种流水线
使该设备在高速行驶时无需求助于昂贵的高速存储器中执行。
特别分支前瞻硬件最小化延迟条件的不连续性。特
有条件的存储操作进一步提高性能。的VCU延伸于C28x的功能
CPU和的C28x +处理器FPU通过添加额外的指令来加速维特比复杂
运算, 16位FFT以及CRC算法。没有修改过,以现有的指令,
管道,或者存储器总线结构。因此,于C28x编写的程序完全兼容
用的C28x + VCU 。
有由FPU模块产生两个事件,去于C28x外设中断扩展
( PIE ) : LVF和LUV 。里面的馅,从外围的C28x这些和其他的事件和记忆造成12
PIE中断PIEINTS [12 : 1 ]到的C28x CPU 。于C28x CPU也接收三个额外的中断
直接(而不是通过PIE)由定时器1 ( TINT1 ) ,由定时器2 ( TINT2 ) ,并从NMI块
(C28uNMIINT).
于C28x有两种低功耗模式:空闲和待机。
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