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XC4000E和XC4000X系列现场可编程门阵列
低。在这段时间内，或只要在程序
输入后，可将CON组fi guration逻辑是一个反面的网络连接G-举行
uration清除内存状态。该CON组fi guration内存
帧连续初始化，使用内部振荡
荡器。
在每一个完整的合格通过帧结束
寻址，电源接通超时延迟电路和
在PROGRAM引脚的电平进行测试。如果既不是断言，
逻辑启动的CON连接gura-一个额外结算
化框架，然后测试INIT输入。
上升时间过长或不好去连接定义。只要PRO-
GRAM是低， FPGA的不断清除其CON组fi guration
内存。当程序变高时， CON组fi guration
存储器清零一次，接着begin-
对CON组fi guration宁，提供的INIT输入不克斯特
应受举行低。需要注意的是低的程序输入
自动强制低的INIT输出。在XC4000
系列PROGRAM引脚有一个永久的弱上拉。
采用集电极开路或漏极开路驱动器来保存INIT
低前CON组fi guration开始使
FPGA完成CON组fi guration内存后等待
清除操作。当INIT不再持有低克斯特
应受，该设备通过的Cap-决定了它CON组fi guration模式
图灵的模式引脚，并准备开始CON组fi guration
流程。主设备最多等待一个额外的250
s
以确保在选购菊花链中的任何奴隶
已经看到， INIT为高。
初始化
在初始化和反对网络配置中，用户销HDC ，最不发达国家，
该系统INIT和DONE提供状态输出接口
脸上。输出最不发达国家， INIT和DONE都保持为低电平，
HDC是在电源的初次申请举办高启动。
之后，网络最终完成初始化的漏极开路INIT引脚被释放
化通过帧地址。有一个deliber-
吃的50250的延迟
s
（达较长时间的低电压10％的
主模式设备前的设备）承认的inac-
略去INIT 。两个内部时钟的INIT引脚被认可后，
为高， FPGA的样品三线模式来确定
雷CON组fi guration模式。适当的接口
线条变得活跃和CON组fi guration序言和
数据可以loaded.Con组fi guration
在0010前导码指示以下24位
代表长度计数。长度计数的总和
要加载的COM需要CON组fi guration时钟数
完整CON组fi guration数据。 （四附加CON组fi guration
时钟必须完成的CON组fi guration过程中，
如下面讨论的。 ）前导码和长度后
计数已通过所有设备菊花
链， DOUT为High ，以防止帧起始位来自
达成任何菊花链设备。
一个特定的 CON组fi guration位，早在一种主的网络连接第一个框架
器设备，控制CON组fi guration时钟速率和能
通过8倍增加。因此，如果快速CON组fi gu-
日粮时钟选择的比特流，较慢的时钟
率一直使用到这种配置位被检测到。
每帧有一个启动网络连接视场，随后由帧CON组fi gu-
配给数据比特和帧误差音响场。如果一帧数据的错误
被检测到时，FPGA停止加载，并通知错误
通过将漏极开路INIT引脚为低电平。毕竟CON连接gura-
化框架已加载到FPGA中，再次DOUT
如下所述输入数据，使得剩余的数据被传递
上到下一个设备。
启动
启动是从CON组fi guration过程中的过渡
预定用户操作。这种转变涉及
从一个时钟源到另一个，和一改变而改变
从接口并行或串行CON组fi guration数据，其中
大部分输出三态，正常操作与I / O引脚
活性在用户系统中。启动必须确保的
用户的逻辑“唤醒”摆好，使输出变为
积极而不引起争用CON组fi guration显
的NAL ，并且内部佛罗里达州的ip-佛罗里达州欢声笑语从释放
全局复位或设置在正确的时间。
图47
描述的启动定时的三个赛灵思FAM-
ilies详细。该CON组fi guration模式可以使用任何的
四个时间序列。
要访问内部启动信号，将启动
库元件。
启动时间
不同的FPGA系列具有不同的启动顺序。
在XC2000系列经过一个固定的序列。 DONE
变高，内部全局复位被去激活的一个
在我之后CCLK周期/ O变得活跃。
该XC3000A系列提供了一些灵活性。 DONE可
编程之前或之后去高一CCLK周期
在I / O变得活跃。独立完成，内部
全局复位停用1 CCLK周期之前或
在我之后/ O变得活跃。
在XC4000系列提供了额外的灵活性。三
事件 - DONE变高，内部置位/复位是
去激活，用户I / O会主动 - 都可以发生
在任何任意序列。他们每个人都可以出现一次
CCLK周期之前或之后，或同时，任何的
的其他人。这种相对定时被选中的软手段
在比特流中生成软件洁具选项。
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延迟CON组fi guration上电后
有延缓CON组fi guration后两种方法
电：把一个逻辑低电平上的程序输入，或拉
双向INIT引脚为低电平，采用集电极开路
（漏极开路）驱动程序。 （见
图46第50页）
低导程序输入是比较激进
的方法，并建议在该电源
1999年5月14日（版本1.6 ）
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