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XC4000E和XC4000X系列现场可编程门阵列
设置CCLK频率
对于主模式， CCLK可以有两种生成
频率。在默认的低速模式下，频率
范围从0.5兆赫至1.25兆赫XC4000E和
XC4000EX设备和从0.6 MHz到1.8兆赫的
XC4000XL设备。在快速CCLK模式下，频率
从4 MHz到10 MHz的范围内进行XC4000EX设备和
从5兆赫至15兆赫的XC4000XL设备。该频
运行的比特流时昆西被选中的选项
生成软件。如果XC4000系列是主驾驶
一个XC3000-或XC2000家族的奴隶，慢CCLK模式
必须使用。此外， XC4000XL设备驱动
XC4000E或XC4000EX应该使用慢速模式。慢速模式
是默认的。
表19 ： XC4000系列数据流格式
数据类型
填充字节
前置码
长度计数
补位
启动现场
数据帧
CRC或恒
现场检查
延长写周期
后记
初创字节
图例：
没有阴影
光
黑暗
所有其他
模式（ D0 ... ）
11111111b
0010b
COUNT （ 23 ： 0 ）
1111b
0b
DATA（ N-1 ：0）
XXXX （CRC）的
或0110b
—
01111111b
XXH
每一次流
一旦每个数据帧
一旦每个设备
数据流格式
的数据流（ “流” ）格式是相同的全部内
组fi guration模式。
的数据流格式示于
表19 。
比特串行
数据从左边读到右边，和字节并行数据便可有效
tively从这个串行比特流组装，与网络连接RST位
在分配给D0的每个字节。
该CON组fi guration数据流开始的8串
的人，一个前导码，接着是24位长度计数
和那些分隔符连接的场。此报头之后是
在帧实际CON组fi guration数据。长度和数量
帧取决于设备的类型（见
表20
和
表21 ） 。
每帧以起始科幻场和结束
带有错误检查。信号结束标记码为必填项
数据的结束为单个设备。在所有情况下，附加
数据初创字节须提供四个时钟为
在CON组fi guration年底启动顺序。长
菊花链需要额外的启动字节移位最后
通过链式数据。所有的启动字节无关位;
这些字节不包括在由生成的比特流
Xilinx软件。
精选CRC或非CRC错误检查是允许的
由位流生成的软件。所述非CRC错误
检查测试帧末端的一个指定网络连接视场的每个
框架。为CRC错误校验，软件计算一
跑CRC ，并插入一个独特的四比特的部分支票
每帧的结束。最后的11位CRC校验
在FPGA的框架包括过去七年的数据位。
检测数据的悬架产生错误负载
荷兰国际集团和拉动INIT引脚下来。在主控模式下，
CCLK和地址信号继续从外部进行操作。
用户必须检测INIT并初始化一个新的CON组fi guration
通过脉冲PROGRAM引脚为低电平或骑自行车VCC。
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1999年5月14日（版本1.6 ）
