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高速串行接口
图55
显示了PCI输入AC时序条件。
CLK
t
PCIVKH
t
PCIXKH
输入
图55. PCI输入AC时序测量条件
图56
显示了PCI输出AC时序条件。
CLK
t
PCKHOV
输出延迟
t
PCKHOZ
高阻抗
产量
图56. PCI输出AC时序测量条件
2.20
高速串行接口
在MPC8535E具有两个串行器/解串器（ SERDES）接口，用于高速串行互连
应用程序。该SerDes1接口是专门针对PCI Express数据传输。该SerDes2可用于SGMII或SATA 。
本节介绍的串行解串器的直流电气规范的公共部分，这是串行解串器的DC要求
参考时钟。在SERDES数据通道的发送器和接收器的参考电路也显示。
2.20.1信号术语定义
该串行解串器采用差分信号，以通过串行链路上传输的数据。本节定义在说明书中使用的术语
和说明书中的差分信号。
图57
显示了信号被限定。为了说明的目的，只有一个SerDes通道被用于描述。上图
示出了用于任一发射机输出（ SDn_TX和SDn_TX ）或接收器输入（ SDn_RX和SDn_RX ）波形。每
一伏特和B之间的信号摆幅伏特其中A > B.
使用该波形中，定义如下。为了简化说明，以下定义假定的SerDes
发送器和接收器操作在一个完全对称的差分信号的环境。
1.
单端摆幅
发射机输出信号和所述接收器的输入信号SDn_TX ， SDn_TX ， SDn_RX和SDn_RX各有一
峰峰值摆幅的A - B伏。这也被称为作为每个信号线的单端摆动。
2.
差分输出电压，V
OD
（或
差分输出摆幅） ：
发射器，V的差分输出电压（或摆动）
OD
，被定义为两个互补输出的差
电压： V
SDn_TX
- V
SDn_TX 。
在V
OD
值可以是正的或负的。
3.
差分输入电压，V
ID
（或
差分输入摆幅） ：
MPC8535E的PowerQUICC III集成处理器的硬件规格，第2版
90
飞思卡尔半导体公司
