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LTC2268-14/
LTC2267-14/LTC2266-14
应用信息
差分编码模式建议用于sinu-
soidal ， PECL ， LVDS或编码输入（图12和图13 ） 。
编码输入通过内部偏置到1.2V
10k的等效电阻。编码输入可以是
上面的V拍摄
DD
（高达3.6V） ，和共模
范围是从1.1V到1.6V 。在差分编码
模式， ENC
–
应保持至少200mV的地上来
避免错误触发的单端编码模式。
为了获得良好的抖动性能ENC
+
应该有快速上升
时间和下降时间。
单端编码模式应该具有CMOS使用
编码输入。要选择此模式， ENC
–
连接
到地面和ENC
+
驱动用方波编码
输入。 ENC
+
可以高于V采取
DD
（高达3.6V ），所以1.8V
至3.3V CMOS逻辑电平可以被使用。在ENC
+
门槛
为0.9V 。为了获得良好的抖动性能ENC
+
应该有快
上升和下降时间。
0.1μF
T1
50Ω
100Ω
0.1μF
50Ω
ENC-
226814 F12
时钟PLL和占空比稳定器
编码时钟乘以一个内部锁相环
环（PLL ），以产生串行的数字输出数据。如果
编码信号改变频率或截止时，PLL
需要25μs的锁定到输入时钟。
时钟占空比稳定器电路允许的占空比
所施加的旋转编码器信号，以改变从30％至70％。
在串行编程模式中，可以用来关闭
占空比稳定器，但不建议这样做。在
并行编程模式的占空比稳定器
始终处于启用状态。
数字输出
该LTC2268-14 / LTC2267-14 /数字输出
LTC2266-14是串行LVDS信号。每个通道
输出两个位在同一时间（ 2车道模式） 。在较低的SAM-
耦率是有1位每通道的选项（ 1车道
模式）。该数据可以与16-， 14- ，或12位的序列化
序列化（见时序图的详细信息） 。注意
12位序列号的两个LSB不可用
- 该模式中包括用于与12位兼容
这些部件的版本。
的输出数据应该在上升沿和下降沿锁存
数据时钟输出（ DCO ）的边缘。一个数据帧输出
（FR ）可以被用于确定何时从一个新的数据
转换结果的开始。在2车道， 14位序列号
模式，对FR输出的频率被减半。
最大串行数据速率为数据输出是
在1Gbps ，因此，ADC的最大采样率将DE-
在序列模式中挂起以及速度等级
ADC的（见表1） 。的最小采样速率为
所有序列模式是5Msps的符号。
ENC
+
LTC2268-14
0.1μF
T1 = MA / COM ETC1-1-13
电阻器和电容器
现在的0402封装尺寸
图12.正弦编码驱动器
0.1μF
ENC
+
PECL或
LVDS
时钟
LTC2268-14
0.1μF
ENC
–
226814 F13
图13. PECL或LVDS编码驱动器
22687614p
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