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Cyclone器件手册，卷1
在全局时钟网络驱动器中的八个全局时钟线贯穿
整个设备。全局时钟网络可提供的时钟对所有
在器件IOEs ， LE和存储块内的资源。全球
时钟线也可以被用于控制信号，例如时钟使能和
从外部管脚，或DQS的供给同步或异步清除
对于DDR SDRAM或FCRAM接口信号。内部逻辑也可以
驱动全局时钟网络内部产生全局时钟和
异步清零，时钟使能，或与其他大的控制信号
扇出。
图2-22
显示驱动全局时钟的各种来源
网络。
图2-22 。全球时钟发生器
注（1）
DPCLK3
DPCLK2
Cyclone器件
全局时钟
网
8
DPCLK1
从逻辑
ARRAY
4
从逻辑
ARRAY
4
DPCLK4
CLK0
CLK1
(3)
PLL1
2
4
4
2
PLL2
(2)
CLK2
CLK3
(3)
DPCLK0
DPCLK5
DPCLK7
DPCLK6
注释
图2-22 ：
(1)
(2)
(3)
在100引脚TQFP封装的EP1C3器件有五个
DPCLK
销（ DPCLK2 ，
DPCLK3 ， DPCLK4 ， DPCLK6 ，
和
DPCLK7).
EP1C3器件只包含一个锁相环（ PLL 1 ） 。
在100引脚TQFP封装的EP1C3器件没有专用时钟引脚
CLK1
和
CLK3.
2–30
初步
Altera公司。
2008年5月
