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电气和热特性
图5提供了交流测试负载的MPC755 。
产量
Z
0
= 50
OV
DD
/2
R
L
= 50
图5. AC测试负载
表10.处理器总线AC时序规范
1
在推荐的工作条件下（参见表3）
所有速度等级
参数
符号
民
建立时间：所有输入
输入保持时间： TLBISYNC ， MCP ， SMI
输入保持时间：所有的输入，除了TLBISYNC ， MCP ， SMI
有效时间：所有输出
输出保持时间：所有输出
SYSCLK输出使能
系统时钟输出高阻抗（除了ABB ， ARTRY ， DBB ）
系统时钟为ABB ， DBB预充电后高阻抗
最大延迟到ARTRY预充电
系统时钟为ARTRY预充电后，高阻抗
t
IVKH
t
IXKH
t
IXKH
t
KHOV
t
KHOX
t
KHOE
t
KHOZ
t
KHABPZ
t
KHARP
t
KHARPZ
2.5
0.6
0.2
—
1.0
0.5
—
—
—
—
最大
—
—
—
4.1
—
—
6.0
1.0
1
2
ns
ns
ns
ns
ns
ns
ns
t
系统时钟
t
系统时钟
t
系统时钟
2
2
2, 3, 4
2, 3, 5
2, 3, 5
6
6
单位
笔记
注意事项：
之前的版本2.8 （修订版E） 1.修正在性能上是有限的，不符合此规范。欲了解更多
的信息，请参见第1.10.2 ， “零件编号本文档不完全解决。 ”
2.通过设计和特性保证。
3. t
系统时钟
是外部时钟（SYSCLK ）在纳秒的周期。在表中给出的号码必须被相乘
SYSCLK的周期来计算所讨论的参数的实际持续时间（单位：ns ） 。
4.每了60倍的总线协议， TS ，ABB和DBB仅由当前活动的总线主控器驱动。它们被断言
低，那么预充电回到高Z ，如图6的标称预充电宽度的TS之前高，
ABB ，或DBB是0.5
×
t
系统时钟
的，即，小于最小吨
系统时钟
期间，要确保另一个主断言TS ，
ABB ，或DBB以下的时钟不会抗衡的预充电。输出有效，输出保持时间是
测试信号置为有效。输出有效时间为预充电测试。高-Z的行为是保证
设计。
5.每60X总线协议， ARTRY可以通过时钟周期立即受到多个总线主控器
下面AACK 。总线争用是因为没有任何主ARTRY主张将驾驶它低的问题。任何
掌握以下AACK预充电前，将会进入到高-Z一个时钟置为低电平，在第一个时钟
AACK的断言之后的第二周期期间高。标称预充电宽度ARTRY是1.0吨
系统时钟
;
也就是说，它应该是高-Z和以前一样的另一个主断言ARTRY的第一次机会，如图6所示。
输出有效，输出保持时间进行测试的信号置为有效。输出有效时间为预充电测试。该
大Z和预充电行为是由设计保证。
6. MCP和SRESET必须保持断言了至少2个总线时钟周期; INT和SMI要追究
有效，直到该异常采取; CKSTP_IN必须保持有效，直到该系统已复位。见
MPC750 RISC微处理器系列用户手册
了解更多信息。
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MPC755 RISC微处理器硬件规格
摩托罗拉
