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TLV320DAC3120
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SLAS659 - 2009年11月
该DAC调制器的时钟由DAC_MOD_CLK 。对于DAC通道的适当电操作，
这些时钟必须通过配置NDAC和MDAC时钟分频器（ 0页面中启用/注册11 ，
位D7 = 1和第0页/注册12位D7 = 1 ） 。当DAC通道被断电时，设备
在内部启动正常关机断电序列。在此期间关断序列中，
NDAC和MDAC分频器不能断电，否则一个合适的低功耗关断可能不会
的地方。用户可以回读电源状态标志0页/注册37位D7和第0页/注册
37位D3 。当两个标志指示掉电时， MDAC分频器可断电，随后
由NDAC分。
在一般情况下，所有的根时钟分频器必须先确定子时钟分频器已断电
断电时正常工作。
该TLV320DAC3120也有一些路由的内部时钟的GPIO1输出引脚来选择
可以用作通用的时钟系统中。的特征示于
图5-18 。
DAC_CLK
DAC_MOD_CLK
BDIV_CLKIN
÷N
N = 1, 2, ..., 127, 128
BCLK
B0362-01
图5-17 。 BCLK输出选项
在当TLV320DAC3120被配置为驱动所述BCLK引脚的模式（0页/寄存器27位D3 = 1） ，
它可以被驱动为BDIV_CLKIN的分割值。分度值可以在网页编程0 /
注册30位D6 - D0从1到128 （见
图5-17 ） 。
该BDIV_CLKIN本身可以被配置成
DAC_CLK （ DAC DSP时钟）或DAC_MOD_CLK通过配置BDIV_CLKIN多路复用器于一体
第0页/注册29位D1 -D0 。此外，通用的时钟可以驱动输出GPIO1 。
这个时钟可以CDIV_CLKIN的分压后的版本。这个时钟分频值可以是
通过写0页/注册26从1到128编程，位D6 -D0 。该CDIV_CLKIN本身可以是
编程的时钟中的一个中显示的列表中
图5-18 。
这可以通过控制
在0页编程多路复用器/寄存器25位D2 -D0 。
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