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HYB39S256400/800/160DT(L)/DC(L)
的256Mbit同步DRAM
信号引脚说明
CLK
CKE
TYPE
输入
输入
信号极性功能
脉冲
水平
正的系统时钟输入。所有的SDRAM的输入是
EDGE
采样时钟的上升沿。
活跃
活跃
激活CLK信号时高,停用
时低,由此开始任一电源CLK信号
关断模式,挂起模式,或自刷新模式。
CS使低时和禁用命令解码器
命令解码器时高。当命令
解码器被禁用,新的命令将被忽略,但
以前的行动仍在继续。
当在时钟的正上升沿采样,
CAS ,RAS和WE定义的命令由执行
SDRAM中。
在一个银行激活指令周期, A0 -A12定义
当在时钟的上升沿采样行地址( RA0 - RA12 )
边缘。
在读或写命令周期中, A0 -的定义
列地址( CA0 - CAN)时,在上升取样
时钟edge.CAn取决于SDRAM组织在:
64M SDRAM ×4 =区域CAn CA9 , CA11 (页长度= 2048比特)
32M SDRAM X8
区域CAn = CA9
(页长度= 1024比特)
16M SDRAM X16
区域CAn = CA8
(页长度= 512位)
CS
输入
脉冲
RAS
CAS
WE
A0 - A12
输入
脉冲
活跃
输入
水平
除了列地址,A10 (= AP)是用来
调用autoprecharge操作在脉冲串的末尾
读或写周期。如果A10很高, autoprecharge是
选择和BA0 , BA1定义要预充电的银行。
如果A10为低, autoprecharge被禁用。
在一个预充电命令周期,A10 (= AP )的使用
与BA0和BA1来控制银行(县)结合
预充电。如果A10很高,所有四家银行将预充电
不管BA0和BA1的状态。如果A10为低,则
BA0和BA1用于哪家银行定义为预充电。
BA0 , BA1输入
DQX
水平
银行选择输入。银行地址输入选择其中
这四家银行的指令适用于。
数据输入/输出引脚以相同的方式操作为上
传统的DRAM 。
输入电平
产量
在网络连接霓虹灯技术
8
2002-04-23

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