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QL82SD器件数据手册版本C
表26 ：输出寄存器单元
符号
输出寄存器单元只有
t
OUTLH
t
OUTHL
t
PZH
t
PZL
t
PHZ
t
PLZ
t
CO
输出延迟低到高（ h的10 ％ ）
输出延迟高至低（ 90 ％的高）
输出延迟三态到高（Z的10％）
输出延迟三态为低（ 90 ％的Z ）
输出延迟高到三态
输出延迟低到三州
时钟到输出延迟
0.40
0.55
2.94
2.34
3.07
2.53
3.15 （快速转换）， 10.2 （慢摆）
参数
传播延迟（ NS ）
H
L
H
Z
L
H
Z
L
tpZH
H
L
H
Z
L
H
Z
L
tOUTHL
tOUTLH
tPZL
tPHZ
tPLZ
图39：输出寄存器单元的时序
电气规格 - 内存模块
[9:0]
[17:0]
WA
WD
WE
WCLK
RCLK
RE
RA
RD
ASYNCRD
[9:0]
[17:0]
[1:0]
模式
图40 ：内存模块
2002 QuickLogic公司
初步
www.quicklogic.com
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