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高速串行接口（ HSSI ）
50
Ω
SDn_REF_CLK
输入
AMP
SDn_REF_CLK
50
Ω
图23.接收串行解串器参考时钟的
9.2.2
DC级别要求的SerDes参考时钟
为MPC8313E SerDes的参照时钟输入端的DC电平的要求是不同的视
如所描述的信令用于连接所述时钟驱动器芯片和SerDes参考时钟输入模式
下文。
差分模式
- 差分时钟的输入振幅一定是400和1600毫伏差之间
峰 - 峰值（或介于200和800 mV的差分峰）。换句话说，每一个信号线
差分对都必须有一个单端摆幅小于800 mV的和大于
200毫伏。这个要求是相同的两个外部直流耦合或交流耦合
连接。
- 对于外部直流耦合连接，如上述
第9.2.1节“串行解串器参考时钟
接收机特性“
的最大平均电流的要求设定为规定
平均电压（共模电压）为100 - 400毫伏。
图24
显示
串行解串器参考时钟输入要求的直流耦合连接方案。
- 对于外部AC耦合连接，不存在共模电压要求的
时钟驱动器。由于外部交流耦合电容器块的DC电平，时钟驱动器
而在SERDES参考时钟接收器工作在不同的命令模式下的电压。该
在此连接方式的SerDes参考时钟接收器有其共模电压设置为
XCOREV
SS
。的差分输入端的各信号线是允许的下方和上方摆动
命令模式电压（ XCOREV
SS
).
图25
显示串行解串器参考时钟输入
要求交流耦合连接方案。
单端模式
- 参考时钟，也可以单端。该SD_REF_CLK输入幅度
（单端摆动）必须为800 400至毫伏峰对峰（从V
民
到V
最大
）随着
SD_REF_CLK无论是悬空或接地。
- 该SD_REF_CLK输入平均电压必须介于200和400毫伏。
图26
节目
在SerDes的参照时钟输入要求的单端信号的模式。
- 为了满足输入振幅的要求，参考时钟输入端，可能需要是直流或
交流耦合到外部。为了获得最佳的噪声性能，该时钟的基准可以是直流
MPC8313E的PowerQUICC
II Pro处理器硬件规格，版本2.1
飞思卡尔半导体公司
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