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高速串行接口（ HSSI ）
9.2
串行解串器参考时钟
在SerDes的参照时钟输入施加到一个内部锁相环，它的输出产生用于由时钟
相应的SerDes通道。在SERDES参考时钟输入SD_REF_CLK和SD_REF_CLK
用于SGMII接口。
以下各节描述的串行解串器参考时钟的要求和一些应用程序
信息。
9.2.1
串行解串器参考时钟接收器特性
图23
示出的串行解串器参考时钟的接收机的参考图。
电源电压要求XCOREV
DD
在指定
表1
和
表2中。
串行解串器参考时钟接收器参考电压电路结构：
- 如所示的SD_REF_CLK和SD_REF_CLK内部交流耦合差分输入
in
图23 。
每个差分时钟输入（ SD_REF_CLK或SD_REF_CLK ）有50
终止XCOREV
SS
接着片上的AC耦合。
- 外部参考时钟驱动器必须能够推动这一终止。
- 该串行解串器参考时钟输入可以是差分或单端。参阅
差模及以下单端方式的描述作进一步详细的要求。
最大平均电流要求也决定了共模电压范围：
- 当串行解串器参考时钟的差分输入是直流耦合的外部与时钟
驱动器芯片，允许为每个输入引脚的最大平均电流为8毫安。在这种情况下，该
确切的共模输入电压是不很严格，因为它是由所允许的范围内
的8毫安（参照以下内容适用于更详细地）最大平均电流，由于
输入被AC耦合的片。
- 该电流限制设置最大共模输入电压小于0.4伏
（ 0.4 V / 50 = 8 mA）的同时，最小共模输入电平为0.1V以上XCOREV
SS
.
例如，用一个50/50的占空比的时钟可以通过用输出的时钟驱动器产生
通过它的电流源从0到16毫安（ 0-0.8 V）驱动，使得差分的各相
输入具有从0V的单端摆动到800毫伏的共模电压为400毫伏。
- 如果设备驱动SD_REF_CLK和SD_REF_CLK投入不能开车50
Ω
to
XCOREV
SS
直流，或超过最大输入电流的限制，那么它必须是
交流耦合的片外。
输入幅度要求。此要求，详细在下面的章节中描述。
MPC8313E的PowerQUICC
II Pro处理器硬件规格，版本2.1
38
飞思卡尔半导体公司
