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高速串行接口（ HSSI ）
表40.串行解串器参考时钟通用AC参数（续）
在与XV推荐工作条件
DD_SRDS1
或XV
DD_SRDS2
= 1.0 V ± 5%.
参数
上升沿率（ SDn_REF_CLK ）到下降沿率
（ SDn_REF_CLK ）匹配
符号
上升下降
匹配
民
—
最大
20
单位
%
笔记
1, 4
注意事项：
1.从测量单端波形措施。
2.从测量差分波形拍摄。
3.测量从-200到+200 mV的差分波形（从SDn_REF_CLK减SDn_REF_CLK派生）上。该
信号必须是单调的，通过测量区域为上升时间和下降时间。 400 mV测量窗口
围绕所述差分过零点。看
图31 。
4.匹配适用于标清上升沿率
n_REF_CLK
和下降沿率SDn_REF_CLK 。它是用一个测
200mV的窗口中心的中位数交叉点，其中的SD
n_REF_CLK
上升满足SDn_REF_CLK下降。中位数
交叉点被用来计算所述电压阈值的示波器是用于边缘速率的计算。的上升边
SDn_REF_CLK率应该是比较SDn_REF_CLK的下降沿率，允许的最大差额
不超过最慢的边缘速率的20％。看
图32 。
上升沿愤怒
秋季边沿速率
V
IH
= 200毫伏
0.0 V
V
IL
= -200 mV的
SDn_REF_CLK
减
SDn_REF_CLK
图31.差分测量点的上升和下降时间
T
秋天
T
上升
SDn_REF_CLK
SDn_REF_CLK
V
CROSS MEDIAN
+ 100毫伏
V
CROSS MEDIAN
V
CROSS MEDIAN
V
CROSS MEDIAN
= 100 mV的
SDn_REF_CLK
SDn_REF_CLK
图32.单端测量点的上升和下降时间匹配
的串行解串器参考时钟的其它详细交流要求通过各接口协议定义
基于应用程序的使用。请参阅以下部分的详细信息：
第8.3.2节， “AC为SGMII SD_REF_CLK和SD_REF_CLK要求
9.2.4.1
扩频时钟
SD_REF_CLK / SD_REF_CLK不旨在一起使用，并且不应该被提供时钟，扩展
频谱时钟源。
MPC8313E的PowerQUICC
II Pro处理器硬件规格，版本2.1
44
飞思卡尔半导体公司
