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莱迪思半导体公司
表17. TCK78 [A ： B]源选择
TCKSEL0
0
1
0
1
ORCA ORT42G5和ORT82G5数据表
TCKSEL1
0
0
1
1
时钟源
通道A
通道B
通道C
通道D
推荐传输时钟分配的ORT82G5
作为推荐的时钟分配方法的一个例子， TSYS_CLK_A [A ：D ]可以通过TCK78A进行采购
如图25 ，如果在发送线路速率是共同的所有四个通道中的一个四边形。类似的时钟会
用于四B.
图25.发送时钟为一个块（类似的连接将被用于B座）
TCK78A
TSYS_CLK_AA
普通逻辑，四路A
AA频道
2
REFCLK [P ： N] _A
156.25兆赫
FPGA
逻辑
TSYS_CLK_AB
AB通道
四个信道的
3.125 Gbps的
即将离任的串行数据
TSYS_CLK_AC
海峡交流
TSYS_CLK_AD
通道AD
所有时钟的
78.125兆赫
如果发送的线路速率的一半，全速率之间的混合之间的通道，则表明该计划
图26可以被使用。在网络连接gure显示TSYS_CLK_AA和TSYS_CLK_AB正在通过采购和TCK78A
TSYS_CLK_AC和TSYS_CLK_AD正源来自TCK78A / 2 （师在FPGA逻辑进行） 。类似
时钟将用于四通道B.
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