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封装和引脚房源
表55. MPC8313E TEPBGAII引脚上市（续）
信号
V
DD
封装引脚数
K11,K12,K13,K14,K15,K
16,L10,L17,M10,M17,
N10,N17,U12,U13,
T1,U2,V2,P5,U4
F6,F10,F19,K6,K10,K17,
K21,P6,P10,P17,R10,
R17,T10,T17,U10,U11,
U14,U15,U16,U17,W6,
W21,AA6,AA10,AA14,
AA19
B1,B2,B8,B9,B16,B17,
C1,C2,C3,C4,C5,C24,
C25,C26,D3,D4,D12,
D13,D20,D21,F8,F11,
F13,F16,F17,F21,G2,
G25,H2,H6,H21,H25,
L4,L6,L11,L12,L13,L14,
L15,L16,L21,L23,M4,
M11,M12,M13,M14,
M15,M16,M23,N1,
N3,N6,N11,N12,N13,
N14,N15,N16,N21,N23,
P11,P12,P13,P14,P15,
P16,P23,P25,R11,R12,
R13,R14,R15,R16,R25,
T6,T11,T12,T13,T14,
T15,T16,T21,T25,U5,
U6,U21,W4,W23,Y4,
Y23,AA8,AA11,AA13,
AA16,AA17,AA21,AC4,
AC5,AC12,AC13,AC20,
AC21,AD1,AE2,AE8,
AE9,AE16,AE17,AF2,
P 2， R 2， T 3 ，P 3 ，V4
PIN TYPE
动力
供应
笔记
V
DDC
VSS
注意事项：
1.该引脚为漏极开路信号。弱上拉电阻（ 1 kΩ的）应放置在该引脚为NV
DD
2.该引脚为漏极开路信号。弱上拉电阻（ 2-10千欧）应放置在该引脚为NV
DD
.
复位期间3.该输出被积极地复位期间驱动，而不是三态。
4.这些JTAG管脚都有内部弱上拉P- FET的是始终启用。
5.该引脚应该有一个弱上拉，如果芯片的PCI主机模式。符合PCI规范的建议。
6.该引脚必须始终连接到VSS 。
MPC8313E的PowerQUICC
II Pro处理器硬件规格，第0版
68
飞思卡尔半导体公司
