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ADSP-21261
串口
以确定是否通信是可能的2之间
在时钟速度n设备，在规格
表23 ，表24 ，
表25 ，表26 ，图21中的
和
图22
必须确认：
1 ）帧同步延迟和帧同步建立和保持; 2）数据延迟
和数据建立和保持;和3） SCLK的宽度。
表23.串行端口，外部时钟
参数
时序要求
t
SFSE
FS设置SCLK前
（外部产生在发送或接收模式FS ）
1
t
高场强元素
FS保持SCLK后
（外部产生在发送或接收模式FS ）
1
接收数据安装程序之前接收SCLK
1
t
SDRE
t
HDRE
接收数据保持SCLK后
1
t
SCLKW
SCLK宽度
t
SCLK
SCLK周期
开关特性
t
DFSE
FS延迟SCLK后
（内部产生在发送或接收模式FS ）
2
t
HOFSE
FS保持SCLK后
（内部产生在发送或接收模式FS ）
2
t
DDTE
数据传输延迟发射后SCLK
2
t
HDTE
传输数据保持SCLK发送后
2
1
2
串行端口信号（SCLK ，FS DXA ， / DXB）被路由至
DAI_P20-1销用主控板。因此，定时规范
下面提供系统蒸发散是在DAI_P20-1引脚有效。
民
最大
单位
2.5
2.5
2.5
2.5
7
20
ns
ns
ns
ns
ns
ns
7
2
7
2
ns
ns
ns
ns
参考样的优势。
引用驱动力。
表24.串行端口，内部时钟
参数
时序要求
t
SFSI
FS设置SCLK前
（外部产生在发送或接收模式FS ）
1
t
HFSI
FS保持SCLK后
（外部产生在发送或接收模式FS ）
1
t
SDRI
接收数据设置SCLK前
1
t
HDRI
接收数据保持SCLK后
1
开关特性
t
DFSI
FS延迟后SCLK （在发送模式下内部产生FS ）
2
t
HOFSI
FS保持SCLK后（内部产生的FS在发送模式）
2
t
DFSI
FS延迟SCLK后（内部产生的FS在接收模式）
2
FS保持SCLK后（内部产生的FS在接收模式）
2
t
HOFSI
t
DDTI
数据传输延迟SCLK后
2
t
HDTI
传输数据保持SCLK后
2
t
SCLKIW
发送或接收SCLK宽度
1
2
民
最大
单位
6
1.5
6
1.5
ns
ns
ns
ns
3
–1.0
3
–1.0
3
–1.0
0.5t
SCLK
– 2
0.5t
SCLK
+ 2
ns
ns
ns
ns
ns
ns
ns
参考样品的边缘。
引用驱动力。
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分页： 44 29 | 2006年3月
