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SN65LVDS302
SLLS733B - 2006年6月 - 修订2007年2月
参数测量信息（续）
tF
吨的设置
- [R [7：0 ] ，G [7： 0]，
B [ 7：0] ， HS，VS ，DE
吨搁置
80% (V
OH
-V
OL
)
20% (V
OH
-V
OL
)
吨OSK
tR
VOH
80% (V
OH
-V
OL
)
PCLK
(CPOL=0)
50 ％ （ VOH -VOL ）
-
20% (V
OH
-V
OL
)
VOL
tF
tR
注意：
在设置CMOS和保持时间输出 [ 7 ： 0 ] ， G [ 7 ： 0 ]
B [ 7：0] ， HS，VS和DE相对于PCLK可以
calulated方式：
1
t
S&H
=
2 -
r
PCLK
-t
REF
- t
OSK
-
D
t
的dUTP
图9.输出上升/下降，建立/保持时间
V
DX +
– V
DX-
, V
CLK +
– V
CLK “
80%(V
ID
)
t
f
100%(V
IC
)
t
r
0V
20%(V
ID
)
0%(V
ID
)
图10. SubLVDS差分输入上升和下降时间确定指标
CLK + ， +的Dx
V
DDLVDS
R
BBDC
R
ID
/2
收益
舞台
R
ID
/2
CLK- ， DX-
待机
发现
行结束
终止
ESD
图11.等效输入电路设计
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