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t
CYC
CLK
t
SE
t
HE
t
CH
t
CL
CEN
t
的HAdV
t
SADV
ADV / LD
t
SW
t
HW
读/写
t
SA
t
HA
A
2
t
SC
t
HC
写周期的时序波形
地址
A
1
(1,2,3,4,5)
IDT71V3557 ， IDT71V3559 ， 128K ×36 ， 256K ×18 ， 3.3V同步SRAM与
ZBT 功能， 3.3VI / O ，突发计数器和流过输出
商用和工业温度范围
6.42
18
t
SB
t
HB
B （A
2
)
B （A
2+1
)
B （A
2+2
)
B （A
2+3
)
t
SD
t
SD
D（一
2
)
D（一
2+1
)
t
HD
D（一
2+2
)
突发写
CE
1
,
CE
2(2)
BW
1
-
BW
4
B （A
1
)
B （A
2
)
OE
t
HD
（ CEN高，消除
目前L-H时钟沿）
（突发绕到
初始状态）
数据
IN
D（一
1
)
D（一
2+3
)
D（一
2
)
写
写
5282 DRW 07
.
,
注意事项：
1. D（一
1
）表示第一输入到外部地址A
1
。 D（一
2
）表示第一输入到外部地址A
2
; D（一
2+1
）表示的基的色同步信号序列的下一个输入数据
地址
2
等在那里的地址比特的
0
AND A
1
在前进的四个字所的国家定义的顺序爆
LBO
输入。
2. CE
2
定时转换是相同的，但反转为
CE
1
和
CE
2
信号。例如，当
CE
1
和
CE
2
是低开这种波形，CE
2
为高。
当新的地址和控制被加载到SRAM通过取样ADV / LD低3.突发结束。
4. R / W是当SRAM被爆破（ ADV / LD采样到高）不关心。的突发访问（读或写）的性质是固定的R / W信号，当新的地址和控制是状态
加载到SRAM中。
5.单个字节的写入信号（ BWX ）必须在所有写入和突发写周期有效。当R / W信号采样为低电平写入周期开始。字节写信息来自于一个周期之前
实际的数据被呈现到SRAM中。
