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40MX和42MX FPGA系列
时序模型
输入延迟
内部延迟
预测
路由
延误
输出延迟
I / O模块
逻辑模块
tIRD1 = 2.09纳秒
tIRD4 = 3.64纳秒
tIRD8 = 5.73纳秒
tPD的= 1.24纳秒
吨CO = 1.24纳秒
TRD1 = 1.28纳秒
TRD2 = 1.80纳秒
tRD4 = 2.33纳秒
tRD8 = 4.93纳秒
I / O模块
tINYL = 0.62纳秒吨
IRD2 = 2.59纳秒
tDLH = 3.32纳秒
腾思= 7.92纳秒
ARRAY
时钟
tCKH = 4.55纳秒
FMAX = 180 MHz的
FO=128
注意：
*值显示为40MX ' 3'测速设备在5.0V最坏情况下的商业条件。
图1-17
40MX时序模型*
输入延迟
I / O模块
tINYL = 0.8纳秒
tIRD1 = 2.0纳秒
组合
逻辑模块
D
Q
tPD的= 1.2纳秒
TRD1 = 0.7纳秒
TRD2 = 1.9纳秒
tRD4 = 1.4纳秒
tRD8 = 2.3纳秒
I / O模块
顺序
逻辑模块
COMBIN
-atoria升
逻辑
包括
tSUD = 0.3纳秒
的tHD = 0.00纳秒
tCKH = 2.70纳秒
F
MAX = 296 MHz的
FO = 32
TLCO = 5.2纳秒（轻载时，焊盘到焊盘）
吨CO = 1.3纳秒
tDLH = 2.5纳秒
内部延迟
预测
路由
延误
输出延迟
I / O模块
t
DLH = 2.5纳秒
G
静省= 0.0纳秒
tINSU = 0.3纳秒
tINGL = 1.3纳秒
D
Q
TRD1 = 0.70纳秒
D
Q
t
ENHZ = 4.9纳秒
G
tOUTH = 0.00纳秒
tOUTSU = 0.3纳秒
tGLH = 2.6纳秒
ARRAY
钟
注意事项：
*值显示为A42MX09 ' 3'在5.0V最坏情况下的商业条件。
输入模块预测布线延迟。
图1-18
42MX时序模型*
v6.0
1-23
