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2.3时钟源
MCLK是外部主时钟输入。时钟电路产生并在整个分发必要的时钟
该设备。当设备在主模式下, SCLK和FS的输出,并以来自MCLK到
提供的设备和一个DSP(数字信号处理器)之间的串行通信的时钟。当在
从模式, SCLK和FS都输入。在SCLK可以连接到一个更快的时钟源,以加快串行
从机与主机之间的通信,而内部时钟保持在每一段FS 256个时钟
进行内部处理。在SPI模式下,该器件为从机和SCLK连接到SPICLK源。
2.4数据输出( DOUT )
DOUT被放置在高阻抗状态完成的LSB的传输之后。初级通信
数据字是ADC转换结果。在二次通信中的数据寄存器读取结果时,
由读/写(R / W)位要求。如果寄存器读不要求,低8位副字是
全零。主/从状态(M / S)终端的MSB在二次通信( DOUT反映,
D15位),以及由LSB的在主通信(DOUT ,位D0) 。
2.4.1
数据输出,主模式
在主控模式下, DOUT是从高阻抗状态由主帧同步( FS )的下降沿。
最显著的数据位则首次出现在DOUT 。
2.4.2
数据输出,从模式
在从模式中, DOUT是从高阻抗状态由外部帧同步信号( FS)的下降沿。
最显著的数据位则首次出现在DOUT 。
2.5数据输入( DIN )
在一个主通信中,数据字是输入数字信号到DAC通道。如果(15 + 1)比特的数据格式是
用的LSB( D0)被用来请求一个二次通信。在二次通信,该数据是
控制和配置数据,设置该设备的特定功能(见第3节,
串行通信) 。
控制的LSB寄存器1确定它是否是一个15位或16位的输入。
2.6 FC (硬件辅助通讯请求)
的FC输入提供了二次通信硬件的要求。 FC一起工作,而LSB的
的主数据字。 FC应接低,如果不使用。
2.7帧同步功能的TLV320AIC11
帧同步信号( FS )表示该设备已准备好发送或接收数据。 FS是一个输出,如果M / S引脚
连接到HI (主模式) ,并输入如果M / S引脚连接到LO (从机模式) 。输出FSD是
第一帧同步信号(FS)即32个SCLK第一FS之后输出,并作为延迟的版本
帧同步输入到下一个从站(参见图2-17 ) 。转出DOUT和DIN到的数据开始于
落下的FS信号的边沿。它可以被配置为一个帧或作为脉冲信号,如通过销M0和M1来确定。
在正常操作中,数字串行接口由移位时钟(SCLK) ,帧同步信号(FS)的,则
的ADC通道的数据输出(DOUT ) ,而DAC通道数据输入(DIN ) 。在主帧同步
间隔时间, SCLK时钟的ADC通道的结果通过了DOUT ,钟表16位/ ( 15 + 1 ) DAC数据通过DIN 。
在二次帧同步间隔,SCLK提供时钟的寄存器的数据输出DOUT通过在正常的操作。如果
读位( D12)被设置为1 ,并在通过DOUT设备传输的控制和设备参数。时机
序列示于图2-1 , 2-2 , 2-3 ,和2-4。
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