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数据表
， 2002年11月
ORCA
4系列的FPGA
一个8 ×8乘法方式是CON连接的可配置到任意一个
两个8位流水线或组合乘数功能
位数字。两个8位操作数相乘，得到
一个16位的乘积。该输入可以在流水线中被注册
模式。
CAM模式
所述CAM块是二进制内容地址存储器
通过接收数据提供快速的地址搜索
输入并且返回包含该数据的地址。
实施中的每个EBR是两个16字×8位CAM
功能块。
凸轮有三种模式，单一的比赛，多
比赛和明确的，这是在一个时钟全部实现
周期。在单个匹配模式，一个8位的数据输入接口
应受解码，并报告了比赛时的数据是
存在于一个特定的RAM地址。其结果是
报由相应的单个地址位。在mul-
tiple匹配相同的发生除多
PLE地址线汇报了比赛。清晰模式用于
通过擦除所有位置中的一个，清除CAM内容
周期的每个位置。在CAM模式的EBR块可
通过级联产生较大的凸轮。
嵌入式RAM块（ EBR ）
（续）
FIFO模式
的FIFO可CON连接gured为256 ， 512 ，或1K深度和
36 ，第18，或9的宽度分别但也可以是
使用多块扩展。 FIFO的工作原理同步的
nously具有相同的读取和写入时钟，其中所述
读端口可以在输出或不寄存器被注册
羊羔。它也可以是任选CON组fi gured asynchro-
nously具有不同读取和写入时钟和
同样读端口寄存器的选择。
集成佛罗里达州AGS允许用户充分利用的能力
的EBR为先进先出，而不需要专门的
地址提供不同的满/空状态。那里
是提供用于每个FIFO四个可编程佛罗里达州AGS ：
空，部分空，满，部分满FIFO台站
土族。部分空的，部分满FL AGS是亲
可编程的灵活性编程FL AGS来
从完整的或空的阈值的任何值。亲
编程值可以通过被设定为一个固定值
比特流或一个动态值可以通过输入来控制
在EBR FIFO的引脚。当FIFO是在asynchro-
理性模式下， FIFO FL AGS采用格雷码计数器
确保适当的无故障运行。
乘数模式
该
ORCA
4系列EBR支持的两种变体
倍频功能。恒COEF网络cient乘法
[ KCM ]模式将产生一个网络连接的一个24位的输出固定的8位
的16位数字或音响常数乘固定的16位
的8位的数字常数的乘法。这KCM多
帘布层的恒定倍一个16位或8位的数目和亲
得到最产品作为一个24位的结果。该COEF连接古老而
乘法表存储在存储器中。输入
可以CON连接gured要注册为流水线。两
写端口可用在乘法模式，使
该用户逻辑可以更新和修改COEF Fi的
cients动态COEF网络cient更新。该
SCUBA
程序中的ispLEVER应用来创建
KCM乘法器，包括初始COEF的输入Fi的
cients 。
莱迪思半导体公司
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