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HYS[64/72]D[16x01/32x00/64x20][G/E]U-[5/6/7/8]-B
无缓冲DDR SDRAM模块
引脚配置
6 DRAM负载
DRAM1
DRAM2
CK R = 120
± 5%
DIMM
连接器
CK
DRAM3
4 DRAM负载
DRAM4
DRAM5
DRAM1
DRAM2
DRAM6
R = 120
± 5%
DIMM
连接器
帽。
帽。
3 DRAM负荷
DRAM1
DRAM5
帽。
R = 120
± 5%
DIMM
连接器
DRAM3
DRAM6
帽。
2 DRAM负荷
DRAM5
DRAM1
帽。
DIMM
连接器
帽。
帽。
R = 120
± 5%
帽。
1 DRAM负荷
帽。
DRAM5
帽。
R = 120
± 5%
DIMM
连接器
DRAM3
帽。
帽。
帽。
帽。
帽。 = 1/2 DDR SDRAM的输入电容; 1.0 pF的± 20％的
图6
时钟网络布线
数据表
16
V1.1, 2003-07
