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R
XC5200系列现场可编程门阵列
表11 ： XC5200位流格式
数据类型
起始字节
数据帧*
循环冗余校验或
恒域检查
填写四位
延长写周期
后记
填充字节（ 30 ）
初创字节
价值
11111110
DATA（ N-1 ：0）
的CRC（ 3：0 ）或
0110
1111
FFFFFF
11111110
FFFF…FF
FF
出现
每一次数据
FRAME
CCLK和地址信号继续从外部进行操作。
用户必须检测INIT并初始化一个新的配置
通过脉冲PROGRAM引脚为低电平或骑自行车VCC。
表12 ：内部配置数据结构
VersaBlock
ARRAY
8x8
10 x 12
14 x 14
18 x 18
22 x 22
舞会
SIZE
（比特）
42,416
70,704
106,288
165,488
237,744
赛灵思
串行PROM
需要
XC1765E
XC17128E
XC17128E
XC17256E
XC17256E
设备
每一次DE-
副
一旦每比特
流
*每帧位（ N）取决于器件的尺寸，如对
表11 。
数据流格式
的数据流（ “流” ）格式是相同的全部内
成形方式，除快速模式。在
快速模式下， DONE当设备被激活
变高，因此没有长度计是必需的。加成
盟友， CRC错误检查是不是在快速模式下支持。
的数据流格式示于
表11 。
表达
模式数据被示为D 0的左侧和D7在右边。
对于所有其他模式中，串行比特数据是从左向右读，
与字节并行数据被有效地从该组装
串行比特流，并在分配给每个字节的第一位
D0.
配置数据流开头的8字符串
的人，一个前导码，接着是24位长度计数
和那些（或24分隔一栏填写位，在快递
模式）。此报头之后是实际的配置
在帧数据。帧的长度和数量取决于
设备类型（见
表12）。
每个帧开头
开始字段和错误检查结束。在所有模式
除了快速模式，后同步码的代码需要显
纳尔为单个设备的数据的末端。在所有的情况下，额外
数据tional启动字节须提供4
的时钟在配置结束的启动顺序。
龙菊链需要额外的启动字节转移
通过该链中的最后一个数据。所有启动字节
无关位;这些字节不包括在比特流cre-
由Xilinx软件ated 。
在快速模式下，只有非CRC错误检查被抑制
移植。在所有其它模式下，选择CRC或非CRC的
错误校验由位流生成允许软
洁具。所述非CRC错误检查测试为一个指定
结束的帧字段的每个帧。对于CRC错误检查，
该软件将计算运行的CRC ，并插入一个独特
在每一帧的结束4比特的部分检查。 11位
CRC校验一个FPGA的最后一帧的包括最后
7个数据位。
检测数据的悬架产生错误负载
荷兰国际集团和拉动INIT引脚下来。在主控模式下，
XC5202
XC5204
XC5206
XC5210
XC5215
每帧的比特= （行数34 x个）+ 28的顶级+ 28
底部+ 4分路器位+ 8的起始位+ 4误差校验位+ 4补
位
*
+ 24扩展写位
= （排34 x个） + 100
*
在XC5202 （8×8 ） ，每帧有8的填充比特，而不是4个
帧的数量= （柱12×数）+ 7为左
对于右边缘+1分离器的比特边+8
= （列12×数） + 16
48 +程序数据= （每帧的帧x数位）
头位+8后置位+ 240补位+ 8的启动位
= + 304 （每帧的帧x数位）
PROM大小=程序数据
循环冗余校验（CRC ），用于
配置和回读
循环冗余校验是错误的方法探测器
灰中的数据传输应用。一般地，反
mitting系统上执行串行计算
比特流。这一计算的结果被标记到
数据流中作为附加的校验位。在接收系统
执行对所述位流和的COM相同的计算
削去的结果与接收到的校验和。
配置比特流中的每个数据帧有四个
在最后的错误比特，如图
表11 。
如果一帧数据
FPGA中，犯人的加载过程中检测到的错误
成形过程中有潜在损坏比特流
终止。该FPGA拉INIT引脚为低电平，并进入
等待状态。
在回读， 11位的16位校验和的添加
到回读数据流的结束。校验和是
计算使用CRC - CCITT的16多项式，如图
in
图23 。
校验由11最显中
的16位的代码效位。在校验和的变化indi-
凯茨在回读位流的变化。比较
到先前的校验和是有意义只有在回读
数据独立于当前的设备状态。 CLB输出
看跌期权不应该包括（读取捕获选项不
使用）。据统计，有一个错误了2048可能会去undetec-
特德。
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1998年11月5日（版本5.2 ）
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