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飞思卡尔半导体公司
SIGNAL /连接描述
SIGNAL分组
动力
1
V
CCN
V
CCQ
地
2
GND
N
GND
Q
时钟输入
CLK
DSP96002
32
/
32
/
地址总线B
BA0–BA31
数据总线B
BD0 - BD31
端口B总线控制
BS1
BS0
BR / W
BWR
BBS
BBL
BTT
BTS
BTA
BAE
BDE
BHS
BHA
BHR
BR
BBG
BBB
BBA
飞思卡尔半导体公司...
中断和模式控制
MODA / IRQA
MODB / IRQB
的MoDC / IRQC
RESET
地址总线A
AA0–AA31
数据总线
AD0–AD31
PORT A总线控制
AS1
AS0
出/写入
AWR
ABS
ABL
ATT
ATS
ATA
AAE
ADE
AHS
哈
AHR
ABR
ABG
ABB
ABA
注意：
1.
2.
32
/
32
/
2
定时/计数器
TIO0–TIO1
片上仿真端口（一次）
DSO
DSI / OSO
DSCK/OS1
DR
电源输入引脚数是包依赖。看
第3节
.
接地连接的数量是取决于封装形式。看
部分
3
.
图1-1
功能组引脚分配
1-2
DSP96002 / D ，第2版
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