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CY7C68001
6.2
56引脚QFN
* WAKEUP
FD15
FD14
FD13
FD12
FD11
FD10
GND
56
GND
VCC
55
VCC
FD9
FD8
NC
54
53
52
51
50
49
48
47
46
45
44
43
* SLRD
* SLWR
AVCC
XTALOUT
XTALIN
AGND
VCC
DPLUS
DMINUS
GND
VCC
GND
* IFCLK
版权所有
1
2
3
4
5
6
7
8
9
10
11
12
13
14
42
41
40
39
38
37
RESET#
GND
* FLAGD / CS #
* PKTEND
FIFOADR1
FIFOADR0
FIFOADR2
* SLOE
INT #
准备
VCC
* FLAGC
* FLAGB
* FLAGA
CY7C68001
56引脚QFN
36
35
34
33
32
31
30
29
15
SCL
16
SDA
图6-2 。 CY7C68001 56引脚QFN分配
[1]
17
VCC
18
FD0
19
FD1
20
FD2
21
FD3
22
FD4
23
FD5
24
FD6
25
FD7
26
GND
27
VCC
28
GND
6.3
CY7C68001引脚说明
名字
AVCC
AGND
DMINUS
DPLUS
RESET#
XTALIN
TYPE
动力
动力
I / O / Z
I / O / Z
输入
输入
默认
不适用
不适用
Z
Z
不适用
不适用
描述
模拟V
CC
。这个信号提供电源给该芯片的模拟部分。
模拟地。
连接到地面尽可能短的路径越好。
USB D-信号。
连接到USB D-信号。
USB D +信号。
连接到USB D +信号。
低电平有效复位。
复位整个芯片。这个引脚通常连接到V
CC
通过100K电阻和GND通过一个0.1 μF的电容。
晶振输入。
这个信号连接到一个24 MHz的并联谐振,基波
心智模式晶体和20 pF的电容到GND 。
表6-1 。 SX2引脚说明
QFN SSOP
3
6
9
8
42
5
10
13
16
15
49
12
文件编号: 38-08013牧师**
第16页39

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