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SN65LV1021/SN65LV1212
10 MHz至40 MHz时， 10 ： 1 LVDS串行器/解串器
SLLS526F - 2002年2月 - 修订2002年11月
时序图和测试电路（续）
7 V （ LZ / ZL ），开放（ HZ / ZH ）
VOH
500
450
任
范围
VOL
TD （ LZ ）
50
VOL
ROUT [9：0 ]
VOH
VOL + 0.5 V
TD （ HZ ）
VOH - 0.5 V
1.5 V
1.5 V
TD （ ZL ）
VOL + 0.5 V
TD （ ZH ）
VOH - 0.5 V
图14.解串器高阻态测试电路和时序
PWRDN
2V
0.8 V
REFCLK
tDSR1
RI
±
TD （ ZHL ）
LOCK
3-State
TD （ HZ ）或TD （ LZ ）
同步模式
1.5 V
数据
不重要
3-State
TD （ ZH ）或TD （ ZL ）
ROUT [9：0 ]
3-State
3-State
同步符号或DIN [ 9 ： 0 ]
RCLK
3-State
RCLK_R / F =低
3-State
任
图15. LVDS接收器输入偏移容限
邮政信箱655303
达拉斯，德克萨斯州75265
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