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2005年6月
修订版0.3
“ SpreadTrak ”
许多系统被设计现在利用技术
所谓扩频频率时序发生。
ASM5I9772A被设计，以便不以滤出的传播
参考输入的光谱特征，假设它
存在。
ASM5I9772A
当一个零延迟缓冲器没有被设计来传递
通过扩频功能，其结果是一
这可能会导致显著量跟踪歪斜的
问题在需要同步的系统。
表1.频率表
反馈输出
分频器
÷4
÷6
÷8
÷10
÷12
÷16
÷20
÷24
÷32
÷40
VCO
输入时钟* 4
输入时钟* 6
输入时钟* 8
输入时钟* 10
输入时钟* 12
输入时钟* 16
输入时钟* 20
输入时钟* 24
输入时钟* 32
输入时钟* 40
输入频率范围
（ AVDD = 3.3V ）
50兆赫至125兆赫
33.3 MHz至83.3 MHz的
25 MHz至62.5 MHz的
20 MHz至50 MHz的
16.6 MHz至41.6 MHz的
12.5 MHz至31.25 MHz的
10兆赫至25兆赫
8.3 MHz到20.8 MHz的
6.25 MHz到15.625 MHz的
5 MHz至12.5 MHz的
输入频率范围
（ AVDD = 2.5V ）
50兆赫至95兆赫
33.3 MHz至63.3 MHz的
25 MHz至47.5 MHz的
20 MHz至38 MHz的
16.6 MHz至31.6 MHz的
12.5 MHz至23.75 MHz的
10 MHz至19 MHz的
8.3 MHz到15.8 MHz的
6.25 MHz到11.8 MHz的
5 MHz到具有9.5MHz
表2.函数表（配置控制）
控制
REF_SEL
TCLK_SEL
VCO_SEL
PLL_EN
INV_CLK
默认
1
1
1
1
1
TCLK0 ， TCLK1
TCLK0
0
晶体振荡器
TCLK1
1
压控振荡器÷2 （低输入频率范围）
旁路模式下， PLL禁用。输入时钟
连接到输出分频器
QC2和QC3是同相的QC0和QC1
输出禁用（三态）和复位
装置。在上电复位/输出禁止PLL反馈
回路是开放的，在它的最小VCO的运行
频率。该器件由内部复位
开机时，电源上电复位（ POR ）电路。
VCO ÷ 1 （高输入频率范围）
使能PLL 。 VCO的输出
连接到输出分频器
QC2和QC3被反转（180°
相移）相对于QC0和
QC1
MR＃ / OE
1
输出启用
2.5V或3.3V ， 200兆赫， 12路输出零延迟缓冲器
注意：本文档中的信息如有更改，恕不另行通知。
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