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初步
功能说明
单一的读访问
当满足以下条件,该访问被启动
满意在时钟的上升: ( 1 ) ADSP或ADSC为低电平, ( 2 )
片选( CE
1
,CE
2
,CE
3
在TQFP ,CE
1
在BGA )断言
活性,和(3)的写信号(毛重, BWE )都被置为无效
HIGH 。如果CE ADSP被忽略
1
为HIGH 。地址提交
到地址输入被存储到地址前进
逻辑和地址寄存器,同时被提交给
内存核心。如果OE输入为低电平时,所要求的
在数据输出最大为t的数据将是可用的
CDV
后时钟的上升。如果CE ADSP被忽略
1
为高。
单写访问发起的ADSP
此访问被启动时,同时满足以下两个条件
满意在时钟的上升: ( 1 ) ADSP为低电平,和( 2 )
芯片使能置为有效。给出的地址被装入
入地址寄存器和地址前进逻辑
同时被输送到RAM核心。写信号( GW ,
在此先BWE和BWX )和ADV输入将被忽略
时钟周期。如果写输入被置为有效(见写
周期说明表中的相应规定,指示
在下一个时钟上升写) ,相应的数据将
LATCHED
书面
INTO
装置。
CY7C1481V33 / CY7C1483V33 / CY7C1487V33提供字节
这是在写周期说明描述写能力
表。断言字节写使能输入( BWE )的
选择字节写( BW
A,B , C,D , E,F , G,H
对于CY7C1487V33 ,
BW
A,B , C,D
对于CY7C1481V33和BW
A,B
对于CY7C1483V33 )
输入将有选择地写入到只有所需的字节数。不是字节
字节写操作过程中选择将保持不变。
所有I / O都在一个字节写三态。
由于CY7C1481V33 / CY7C1483V33 / CY7C1487V33
是一种常见的I / O设备,输出使能( OE )必须
提交数据到DQX输入之前拉高高。
这样做将三态输出驱动器。作为安全
CY7C1481V33
CY7C1483V33
CY7C1487V33
谨慎起见, DQX会自动三态每当
写周期被检测到,无论OE的状态。
单写访问发起ADSC
ADSC写访问被当以下条件启动
系统蒸发散是满足: ( 1 ) ADSC为低电平, ( 2 )是ADSP
拉高HIGH , ( 3 )芯片使能( CE
1
,CE
2
,CE
3
在TQFP ,
CE
1
上的BGA )置为有效,和(4)适当的combi-
的写输入( GW , BWE和BW的国家
x
)断言
积极进行写操作所需的字节( S) 。 ADSC是
如果忽略ADSP为低电平有效。
呈现给地址
[17:0]
被加载到地址
而被注册和地址的进步逻辑
传送到RAM的核心。在ADV输入被忽略
这个周期。如果全局写操作进行时,数据呈现给
该DQX被写入在相应的地址位置
RAM中的核心。如果一个字节写操作进行的,只有选择
字节写入。在一个字节写入字节未选择
操作将保持不变。所有I / O的三态
在一个字节写,因为CY7C1481V33 /
CY7C1483V33 / CY7C1487V33是一种常见的I / O设备时,
输出使能( OE )之前,必须先拉高高
呈现数据的DQX输入。这样做将三态
输出驱动器。为安全起见, DQX是自动
三态每当一个写周期被检测,而不管
OE的状态。
突发序列
该CY7C1481V33 / CY7C1483V33 / CY7C1487V33提供
二位环绕式计数器,由美联储
[1:0]
,实现
无论是交错或线性突发序列。支持
遵循线性脉冲串序列的处理器。爆
顺序是用户可选择通过MODE输入。
主张ADV较低,时钟的上升会自动递增
该数据串计数器中的脉冲串序列中的下一个地址。
读取和写入,支持突发操作。
周期说明
下一个周期
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0
CE
3
X
1
X
1
X
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0
X
X
X
X
X
CE
2
X
X
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X
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1
1
X
X
X
X
X
CE
1
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0
X
X
1
1
X
ADSP
X
0
0
1
1
0
1
1
1
X
X
1
ADSC
0
X
X
0
0
X
0
1
1
1
1
1
ADV
X
X
X
X
X
X
X
0
0
0
0
1
OE
X
X
X
X
X
X
X
1
0
1
0
1
DQ
高阻
高阻
高阻
高阻
高阻
高阻
高阻
高阻
DQ
高阻
DQ
高阻
X
X
X
X
X
X
注意事项:
1, X = “不在乎。 ” 1 = HIGH , 0 =低。
2.写由BWE , BWX和GW定义。见写周期说明表。
3. DQ管脚由当前周期和所述参考信号的控制。 OE是异步的,并且不采样的时钟。
4. CE
1
,CE
2
和CE
3
只适用于TQFP封装。 BGA封装具有一个片选CE
1
.
文件编号: 38-05284修订版**
第9页的30

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