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HYS64D128021[H/G]BDL–[5/6]–B
小外形封装DDR SDRAM模块
引脚配置
2
表3
符号
A0 - A12
BA0 ， BA1
DQ0 - DQ63
引脚配置
引脚定义和功能
TYPE
1)
I
I
I / O
I
I
I / O
I
I
I
I
PWR
GND
PWR
PWR
AI
PWR
I
I / O
I
NC
NU
功能
地址输入
银行地址
数据输入/输出
命令输入
时钟使能
SDRAM数据选通
SDRAM时钟（真实信号）
SDRAM时钟（互补信号）
数据屏蔽
芯片选择
电源（ + 2.5V）
地
I / O驱动器电源
VDD评判识别标志
I / O基准源
串行EEPROM电源
串行总线时钟
串行总线的数据线
从地址选择
没有连接
没有可用的，为将来使用保留
RAS ， CAS ， WE
CKE0 - CKE1
DQS0 - DQS7
CK0 - CK1 ，
CK0 - CK1
DM0 - DM8
S0, S1
2)
V
DD
V
SS
V
DDQ
V
DDID
V
REF
V
DDSPD
SCL
SDA
SA0 - SA2
NC
NU
1 ） I：输入; ○：输出; I / O ：双向输入/输出; AI ：模拟量输入; PWR ：电源; GND ：信号地; NC ：不
连接; NU ：不可用
2） CKE1和S1上只有两个银行模块用于
数据表
8
修订版0.5 ， 2003-12
