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莱迪思半导体公司
ispClock5600系列数据手册
引脚说明（续）
引脚数
引脚名称
VCCD
GNDD
VCCJ
REFA +
REFA-
REFB +
REFB-
REFSEL
REFVTT
FBKA +
FBKA-
FBKB +
FBKB-
FBKSEL
FBKVTT
TDO
TDI
TCK
TMS
LOCK
SGATE
GOE
OEX
OEY
PS0
PS1
RESET
TEST1
TEST2
N / C
版权所有
数字GND
JTAG接口VCC
参考时钟正输入
参考时钟的负输入端
参考时钟B正输入端
参考时钟B负输入端
参考时钟选择输入（ LVCMOS ）
终止电压参考输入
时钟反馈的正输入端
时钟反馈的负输入端
时钟反馈B正输入端
时钟反馈B负输入端
时钟反馈选择输入（ LVCMOS ）
终止电压反馈输入端
JTAG TDO输出线
JTAG TDI输入线
JTAG时钟输入
JTAG模式选择
PLL锁定指示灯， LOW表示PLL锁相
同步输出门
全球输出使能
OUTPUT ENABLE 1
输出使能2
廓选择0
廓选择1
复位PLL
测试输入1 - 连接到GNDD
测试输入2 - 连接到GNDD
无内部连接
厂家使用 - 不要连接
描述
数字内核VCC
PIN TYPE
动力
GND
动力
输入
输入
输入
输入
输入
1
动力
输入
输入
输入
输入
Input1
动力
产量
输入
2
输入
输入
输入
2
ispClock5610
48 TQFP
24, 33
23, 48
36
18
19
—
—
—
20
15
16
—
—
—
17
35
39
38
37
34
40
42
21
22
44
43
47
41
46
45
—
—
ispClock5620
100 TQFP
47, 71
46, 93
74
38
39
42
41
43
40
32
33
36
35
37
34
73
84
83
82
72
85
87
44
45
89
88
92
86
91
90
1, 2, 23, 24, 25, 26, 27,
28, 29, 48, 49, 50, 75,
76, 77, 78, 79, 94, 97,
98, 99, 100
80, 81, 95, 96
产量
1
输入
1
输入
输入
输入
1
输入
输入
输入
1
1
1
PLL_BYPASS PLL旁路
输入
输入
不适用
不适用
1.内部下拉电阻。
2.内部上拉电阻。
40
