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数据表
特点
低相位噪声，锁相环（PLL）的
片内VCO调谐从2.30 GHz到2.65 GHz的
外部VCO / VCXO至2.4 GHz的可选
1路差分或2路单端基准输入
参考监控能力
返回式自动和手动参考
切换/缓缴模式
接受LVPECL ， LVDS或CMOS的参考频率为250 MHz
在路径PFD可编程延迟
数字或模拟锁定检测，可选
3对1.6 GHz的LVPECL输出
每对输出共用一个1至32分频器用粗
相位延迟
添加剂输出抖动： 225 fs的有效值
通道至通道偏移配对的<10 ps的输出
上电时所有输出自动同步
手动输出同步提供
采用48引脚LFCSP封装
6路输出时钟发生器与
集成2.5 GHz的VCO
AD9518-1
功能框图
CP
LF
切换
和监控
REF1
REFIN
REF2
状态
MONITOR
PLL
VCO
CLK
分频器
及的MUX
DIV / Φ
DIV / Φ
DIV / Φ
串行控制端口
和
数字逻辑
LVPECL
LVPECL
LVPECL
OUT0
OUT1
OUT2
OUT3
OUT4
OUT5
图1 。
应用
低抖动，低相位噪声时钟分配
10/40/100 Gb /秒的网络线卡，包括SONET ，
同步以太网， OTU2 / 3/4
前向纠错（ G.710 ）
时钟高速ADC ， DAC的， DDS中， DDC的，公爵， MxFEs
高性能无线收发器
ATE和高性能仪器仪表
概述
该
AD9518-1
1
提供多路输出时钟分配
功能与亚皮秒级抖动性能，以及一个
片上PLL和VCO 。片内VCO调谐从2.30 GHz到
2.65 GHz的。或者，高达2.4 GHz的外部VCO / VCXO
都可以使用。
该
AD9518-1
强调低抖动和相位噪声最大化
数据转换器的性能，并且它可以使用其他应用程序
用苛刻的相位噪声和抖动要求。
该
AD9518-1
拥有6 LVPECL输出（三对） 。
LVPECL输出工作于1.6 GHz的。
对于需要额外的输出的应用中，晶体
参考输入端，零延迟，或EEPROM，用于自动
在启动配置中，
AD9520
和
AD9522
是可用的。
此外，该
AD9516
和
AD9517
类似于
AD9518
但有输出的不同组合。
每对输出都有分频器，使两者的鸿沟
比和粗调延迟（或相位）进行设置。划分范围
对于LVPECL输出为1 32 。
该
AD9518-1
在一个48引脚LFCSP封装，可以是
从3.3 V单电源供电。外部VCO ，这
需要更大的电压范围内，可通过收纳
连接电荷泵电源（ VCP）至5 V的独立
LVPECL电源可以为2.5 V至3.3 V （标称值） 。
该
AD9518-1
是在工业中指定的操作
范围为-40 ° C至+ 85°C 。
1
AD9518
用于整个数据表指的所有成员
AD9518
家庭。然而，当
AD9518-1
被使用时，它指的是特定
会员单位
AD9518
家庭。
版本C
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AD9518-1
