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时钟CON组fi guration模式
在PCI代理模式（ MODCK_HI = 0000 ）表18.时钟的默认配置（续）
MODCK[1–3]
100
101
110
111
1
2
1
CORE
输入时钟
CPM
CORE
CPM
公交司60X巴士
乘法
倍频
3
频率
频率
因素
频率
4
因素
（ PCI）的
2
因素
2
66/33 MHz的
66/33 MHz的
66/33 MHz的
66/33 MHz的
3/6
3/6
4/8
4/8
200兆赫
200兆赫
266兆赫
266兆赫
3
3.5
3.5
3
240兆赫
280兆赫
300兆赫
300兆赫
2.5
2.5
3
2.5
80兆赫
80兆赫
88兆赫
100兆赫
假定MODCK_HI = 0000 。
该频率取决于PCI_MODCK的值。如果PCI_MODCK是高（逻辑“1” ）时，PCI的分频比
由图2（ 33代替66兆赫等）和CPM乘法系数乘以2.参考
表15 。
3
核心频率= （ 60X总线频率） （核心倍频系数）
4
总线频率= CPM频率/总线分频因子
表19
描述了所有可能的时钟配置使用MPC8265和MPC8266的内部时，
在代理模式PCI桥。
表19.时钟体质的PCI代理模式组fi guration模式
输入时钟
CORE
CPM
CORE
MODCK_H -
CPM
公交司60X巴士
倍频
乘法
3
频率
MODCK[1–3]
频率
因素
频率
4
（ PCI）的
1,2
因素
因素
1
0001_001
0001_010
0001_011
0001_100
66/33 MHz的
66/33 MHz的
66/33 MHz的
66/33 MHz的
2/4
2/4
2/4
2/4
133兆赫
133兆赫
133兆赫
133兆赫
5
6
7
8
166兆赫
200兆赫
233兆赫
266兆赫
4
4
4
4
33兆赫
33兆赫
33兆赫
33兆赫
0010_001
0010_010
0010_011
0010_100
50/25 MHz的
50/25 MHz的
50/25 MHz的
50/25 MHz的
3/6
3/6
3/6
3/6
150兆赫
150兆赫
150兆赫
150兆赫
3
3.5
4
4.5
180兆赫
210兆赫
240兆赫
270兆赫
2.5
2.5
2.5
2.5
60兆赫
60兆赫
60兆赫
60兆赫
0011_000
0011_001
0011_010
0011_011
0011_100
66/33 MHz的
66/33 MHz的
66/33 MHz的
66/33 MHz的
66/33 MHz的
2/4
2/4
2/4
2/4
2/4
133兆赫
133兆赫
133兆赫
133兆赫
133兆赫
2.5
3
3.5
4
4.5
110MHz
132兆赫
154兆赫
176MHz
198兆赫
3
3
3
3
3
44兆赫
44兆赫
44兆赫
44兆赫
44兆赫
0100_000
0100_001
0100_010
0100_011
66/33 MHz的
66/33 MHz的
66/33 MHz的
66/33 MHz的
3/6
3/6
3/6
3/6
200兆赫
200兆赫
200兆赫
200兆赫
2.5
3
3.5
4
166兆赫
200兆赫
233兆赫
266兆赫
3
3
3
3
66兆赫
66兆赫
66兆赫
66兆赫
MPC8260A的PowerQUICC II集成通信处理器的硬件规格，版本2.0
30
飞思卡尔半导体公司
