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SMJ320F240
DSP控制器
SGUS029C - 1999年4月 - 修订2004年9月
该SMJ320F240 DSP CPU的功能框图
程序总线
IS
DS
PS
读/写
STRB
准备
BR
XF
X1
CLKOUT1
CLKIN/X2
控制
MUX
程序总线
16
16
程序总线
16
W / R
WE
NMI
PC
PAR
MSTACK
MUX
RS
MP / MC
XINT[1--3]
堆栈8
×
16
3
闪存EEPROM
16
16
16
16
MUX
MUX
程序控制
（ PCTRL ）
16
A15--A0
16
D15--D0
16
16
16
数据总线
3
AR0(16)
AR1(16)
AR2(16)
ARP(3)
3
ARB(3)
3
AR3(16)
AR4(16)
AR5(16)
AR6(16)
AR7(16)
3
16
ISCALE （ 0--16 ）
9
DP(9)
16
16
9
7
最低位
从
IR
16
16
数据总线
16
MUX
16
MUX
TREG0(16)
倍增器
PREG(32)
32
PSCALE （ --6,0,1,4 ）
32
16
32
MUX
MUX
CALU(32)
32
32
ARAU(16)
16
存储器映射
注册
IMR （ 16 ）
IFR （ 16 ）
GREG （ 16 ）
32
MUX
数据/编程
DARAM
B0 (256
×
16)
MUX
数据
DARAM
B2 (32
×
16)
B1 (256
×
16)
MUX
16
16
16
ACCH （ 16 ）
ACCL(16)
32
OSCALE （ 0-7 ）
16
注意事项： A.符号描述出现在表10中。
B.对于清晰度的数据和程序总线虽然它们包括地址和数据位显示为单个总线。
30
邮政信箱1443
休斯敦，得克萨斯州77251--1443
数据总线
NPAR
