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设备架构
时钟源
输入LVDS / LVPECL宏
时钟调理
CLKA
GLA
EXTFB
LOCK
断电
产量
PADN
PADP
Y
GLB
YB
GLC
YC
OADIVRST
OADIVHALF
OADIV [4 ：0]的
OAMUX [2 ：0]的
DLYGLA [4 ：0]的
OBDIV [4 ：0]的
OBMUX [2 ：0]的
DLYYB [4 ：0]的
DLYGLB [4 ：0]的
OCDIV [4 ：0]的
OCMUX [2 ：0]的
DLYYC [4 ：0]的
DLYGLC [4 ：0]的
FINDIV [6：0 ]
FBDIV [6：0 ]
FBDLY [4 ：0]的
FBSEL [1 ：0]的
XDLYSEL
VCOSEL [2 ：0]的
INBUF
2
万家乐
Y
PAD
GLA
or
GLA和（ GLB或YB ）
or
GLA和（ GLC或YC ）
or
GLA和（ GLB或YB ）和
（ GLC或YC ）
注意事项：
1.访问
Microsemi的SoC产品集团网站
对于相关的动态重新配置PLL应用笔记。请参阅
该
第2-29页的"PLL Macro"节
信号说明。
2.许多具体INBUF宏支持多种单端和差分I / O标准的Fusion系列。
3.请参阅
IGLOO ，的ProASIC3 ， SmartFusion的融合和宏库指南
了解更多信息。
图2-19
融合CCC选项：与PLL宏全球缓冲器
表2-11
的I / O标准内CLKBUF和CLKBUF_LVDS / LVPECL宏可用的选择
CLKBUF宏
CLKBUF_LVCMOS5
CLKBUF_LVCMOS33
1
CLKBUF_LVCMOS18
CLKBUF_LVCMOS15
CLKBUF_PCI
CLKBUF_LVDS
2
CLKBUF_LVPECL
注意事项：
1.这是默认的宏。有关详细信息，请参阅
IGLOO ，的ProASIC3 ， SmartFusion的融合和宏库
指导。
2， B- LVDS和M -LVDS标准与CLKBUF_LVDS支持。
2- 24
的Visio 4
