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外围工作要求和行为
S1
S2
S2
I2S_MCLK （输出）
S3
I2S_TX_BCLK/
I2S_RX_BCLK （输出）
S5
S4
S4
S6
I2S_TX_FS/
I2S_RX_FS （输出）
S9
S10
I2S_TX_FS/
I2S_RX_FS （输入）
S7
S8
S7
S8
I2S_TXD
S9
S10
I2S_RXD
图27. I2S / SAI计时 - 主模式
表51. I2S /在VLPR ， VLPW SAI从模式时序和VLPS模式（全
电压范围）
NUM 。
工作电压
S11
S12
S13
S14
S15
S16
S17
S18
S19
I2S_TX_BCLK / I2S_RX_BCLK周期时间（输入）
I2S_TX_BCLK / I2S_RX_BCLK脉宽高/低
（输入）
前I2S_TX_FS / I2S_RX_FS输入设置
I2S_TX_BCLK/I2S_RX_BCLK
后I2S_TX_FS / I2S_RX_FS输入保持
I2S_TX_BCLK/I2S_RX_BCLK
I2S_TX_BCLK到I2S_TXD / I2S_TX_FS输出有效
I2S_TX_BCLK到I2S_TXD / I2S_TX_FS输出无效
I2S_RX_BCLK前I2S_RXD设置
I2S_RXD持有I2S_RX_BCLK后
I2S_TX_FS输入断言I2S_TXD输出有效
1
特征
分钟。
1.71
250
45%
30
7.6
—
0
30
6.5
—
3.6
—
55%
—
—
67
—
—
—
72
马克斯。
V
ns
MCLK周期
ns
ns
ns
ns
ns
ns
ns
单位
1.适用于第一比特在每个帧中，仅在TCR4 [ FSE ]位被清零
K50次系列数据手册，第2版， 4/2012 。
飞思卡尔半导体公司
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