ST24LC21B ， ST24LW21
ST24FC21 ， ST24FW21
1千位的（x8）双模串行EEPROM
对于VESA PLUG & PLAY
100万次擦/写
40年数据保留
3.6V至5.5V的单电源电压
硬件写控制（ ST24LW21
和ST24FW21 ）
在VCLK输入TTL施密特触发器
10万/ 400K赫兹兼容的I
2
C
BUS位传输范围
两线串行接口I
2
C总线
兼容
I
2
C页面写（最多8个字节）
I
2
字节，随机和顺序读
模式
自定时编程周期。
自动地址递增
增强型ESD /闩锁
表演
错误恢复机制
（ ST24FC21和ST24FW21 ） VESA 2
兼容
描述
该ST24LC21B ， ST24LW21 ， ST24FC21和
ST24FW21是1K位电可擦除亲
可编程存储器（EEPROM ） ，组织
128x8位。在文中，产品被称为
ST24xy21 ，其中"x"要么是"L"的VESA 1或"F"
对于VESA兼容2和回忆的地方"y"
表示写控制引脚连接： "C"
指WC引脚7和"W"意味着WC 3针。
表1.信号名称
SDA
SCL
V
CC
V
SS
VCLK
WC
串行数据地址输入/输出
串行时钟（我
2
C模式）
电源电压
地
时钟只传输模式
写控制
注意：
WC信号仅适用于ST24LW21和ST24FW21
产品。
8
1
PSDIP8 （ B）
0.25毫米框架
8
1
SO8 （M ）
150mil宽度
图1.逻辑图
VCC
SCL
VCLK
WC
ST24xy21
SDA
VSS
AI01741
1999年1月
1/21
ST24LC21B ， ST24LW21 ， ST24FC21 ， ST24FW21
图2A 。 DIP引脚连接
图2B中。 SO引脚连接
ST24LC21B
NC
NC
NC
VSS
1
2
3
4
8
7
6
5
AI01742
ST24LC21B
VCC
VCLK
SCL
SDA
NC
NC
NC
VSS
1
2
3
4
8
7
6
5
AI01743
VCC
VCLK
SCL
SDA
警告：
NC =未连接。
警告：
NC =未连接。
图2C 。 DIP引脚连接
图2D 。 SO引脚连接
ST24FC21
NC
NC
DU
VSS
1
2
3
4
8
7
6
5
AI01744
ST24FC21
VCC
VCLK
SCL
SDA
NC
NC
DU
VSS
1
2
3
4
8
7
6
5
AI01745
VCC
VCLK
SCL
SDA
警告：
NC =未连接。 DU =不使用，必须
悬空或连接到V
CC
或V
SS
.
警告：
NC =未连接。 DU =不使用，必须
悬空或连接到V
CC
或V
SS
.
图2E 。 DIP引脚连接
图2F 。 SO引脚连接
ST24FW21
ST24LW21
NC
NC
WC
VSS
1
2
3
4
8
7
6
5
AI01746
ST24FW21
ST24LW21
VCC
VCLK
SCL
SDA
NC
NC
WC
VSS
1
2
3
4
8
7
6
5
AI01747
VCC
VCLK
SCL
SDA
警告：
NC =未连接。
警告：
NC =未连接。
2/21
ST24LC21B ， ST24LW21 ， ST24FC21 ， ST24FW21
表2.绝对最大额定值
(1)
符号
T
A
T
英镑
T
领导
V
IO
V
CC
V
ESD
参数
工作环境温度
储存温度
焊接温度，焊接
输入或输出电压
电源电压
静电放电电压（人体模型）
(2)
静电放电电压（机器型号）
(3)
（ SO8封装）
（ PSDIP8包）
40秒
10秒
价值
-40到85
-65到150
215
260
-0.3 6.5
-0.3 6.5
4000
500
单位
°C
°C
°C
V
V
V
V
注意事项：
1.除评级"Operating温度Range" ，上面讲的那些表"Absolute最大Ratings"上市
可能对器件造成永久性损坏。这些压力额定值只，设备的操作在这些或任何其他
超出本规范的经营部门所标明的条件是不是暗示。暴露在绝对最大
额定值条件下工作会影响器件的可靠性。另请参阅意法半导体处处计划和其他
相关的质量文件。
2. MIL -STD- 883C ， 3015.7 （ 100pF的， 1500
).
3. EIAJ IC- 121 （条件C ） （ 200pF的， 0
).
表3.设备选择代码
器件代码
位
设备选择
b7
1
b6
0
b5
1
b4
0
b3
X
芯片使能
b2
X
b1
X
RW
b0
RW
注意：
在B7 MSB首先发送。
X = 0或1 。
描述
（续）
该ST24xy21可以工作在两种模式：反
MIT -only模式，我
2
双向模式。当
供电，该装置是在发送- Only模式与
EEPROM数据从上升沿同步输出
上VCLK施加的信号。
该设备将切换到我
2
双向模式
经信号施加在SCL下降沿
引脚。当我
2
C模式中， ST24LC21B （或
ST24LW21 ）无法切换回发送
唯一模式（除了当电源重新
移动）。为ST24FC21 （或ST24FW21 ）
SCL的下降沿之后，存储器输入在
过渡状态，可以切换回
发送-only模式，如果没有有效的I
2
C活性是
观察到。器件工作的电源
值低至+ 3.6V 。这两种塑料双列直插
和塑料小外形封装。
仅用于发送模式
经过上电时， ST24xy21处于发送
Only模式。一个适当的初始化序列（见
图3 ）必须提供9个时钟脉冲的
VCLK引脚（以内部同步
装置） 。在该初始化序列，该
SDA引脚处于高阻抗。上升沿
第十脉冲的应用VCLK引脚上，该装置
将输出字节的第一位位于地址为00h
（第一最显著位）。
一个字节同步输出（在SDA引脚）与九个时钟
上VCLK脉冲： 8个时钟脉冲的数据字节
和一个额外的时钟脉冲为无关位。
只要SCL引脚保持高电平，每个字节
存储器阵列被串行发送到SDA
引脚自动地址递增。
当最后一个字节被发送，地址
计数器将结转至地址00h 。
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ST24LC21B ， ST24LW21 ， ST24FC21 ， ST24FW21
图3.仅发送模式波形
VCC
SCL
SDA
Tvpu
VCLK
1
2
8
9
10
第7位
第6位
11
VCC
SCL
SDA
第6位
第5位
4位
位0
第7位
第6位
VCLK
12
13
17
18
19
20
AI01501
表4.我
2
C的工作模式
模式
当前地址
读
随机地址
读
顺序读取
字节写
页写
注意：
X = V
IH
或V
IL
RW
位
’1’
’0’
’1’
’1’
’0’
’0’
ST24LC21B
ST24FC21
VCLK
X
X
X
X
V
IH
V
IH
ST24LW21
ST24FW21
WC
X
X
X
X
V
IH
V
IH
字节
初始序列
1
1
1至128
1
8
开始，设备选择， RW = ' 1 '
开始，设备选择， RW =' 0 ' ，地址，
重新启动，设备选择， RW = ' 1 '
类似于目前或随机模式
开始，设备选择， RW =' 0 '
开始，设备选择， RW =' 0 '
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ST24LC21B ， ST24LW21 ， ST24FC21 ， ST24FW21
从仅发送（ DDC1 ）到双向（ DDC2B ）模式波形图4.转型
仅用于发送模式
- 临时双向模式
（ ST24FC21和ST24FW21 ）
- 锁定的双向模式
（ ST24LC21B和ST24LW21 ）
2
8
9
- 锁定双向
模式（ ST24FC21
和ST24FW21 ）
SCL
1
SDA
最高位
确认
VCLK
开始
条件
AI01892
I
2
双向模式
该ST24xy21可以从发送切换只
模式我
2
双向模式，通过应用有效
高在SCL引脚为低电平跳变（见图4） 。
- 当ST24LC21B （或ST24FC21 ）是在
在我
2
双向模式下，输入VCLK
（引脚7 ）允许（或禁止）的执行
任何写指令：如果VCLK = 1 ，写指令
系统蒸发散执行;如果VCLK = 0 ，写指令
不执行系统蒸发散。
- 当ST24LW21 （或ST24FW21 ）是在
在我
2
双向模式，写控制
（ WC引脚3 ）输入使能（或抑制）的
任何执行写指令：如果WC = 1 ，
写指令的执行;如果WC = 0 ，
不执行写指令。
该ST24xy21是与I兼容
2
C标准，
2线串行接口，它使用一个双向
数据总线和串行时钟。该器件带有一个
内置的4位，独一装置识别码
对应的（ 1010 ）命名的设备选择代码
给我
2
C总线定义。
该ST24xy21行为作为一个从设备
I
2
所有的内存操作C协议同步的
由串行时钟SCL认列。读取和写入
操作是通过启动条件启动gen-
总线主机产生的。启动条件
接着的7位（设备选择码流
1010XXX ） ，加上一个读/写位和终止
一个应答位。
当数据被写入存储器，则
ST24xy21响应由AS-接收到的8位
在第9位的时间serting一个应答位。
当数据由总线主机读取，就必须
确认收到的数据字节
方式相同。数据传输结束了
停止条件（见READ和WRITE descrip-
在下面的页面系统蒸发散） 。
上电复位： V
CC
锁定写保护
为了防止数据损坏和意外的
上电时，上电写入操作
复位（POR）电路来实现。直到V
CC
电压达到POR阈值
（约3V ） ，内部复位有效，所有的操作
就失效，器件不会响应
对任何命令。以同样的方式，当V
CC
滴剂
下来的工作电压低于POR
阈值，所有的操作被禁止，
设备不会响应任何命令。稳定
V
CC
应用任何逻辑之前，必须应用
信号。
5/21
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