【通过订购此文件M68000UMAD/AD通信和高级消费科技集团M68000增编M68000用户手册1】,IC型号BR729,BR729 PDF资料,BR729经销商,ic,电子元器件-51电子网

通过订购此文件

M68000UMAD/AD

通信和高级

消费科技集团

M68000

增编

M68000

用户手册

1997年8月7日

该增编

M68000UM / AD用户手册

修订8 ，提供更正原文为

以及附加信息。这对这款产品文档和其他信息保持的世界

万维网在http://www.motorola.com/68000 。

概观

本手册包括硬件细节和编程信息的MC68HC000 ， MC68HC001的，

该MC68EC000和MC68SEC000 。为了便于阅读，名称M68000主控板时，将使用

参照所有处理器。请参阅M68000PM / AD ，

M68000程序员参考手册

，详细

在MC68000指令集的信息。

四个微处理器都非常相似，彼此都具有以下特点：

16个32位数据和地址寄存器

16M字节的直接寻址范围

程序计数器

6指令类型

对五种主要的数据类型的操作

内存映射输入/输出（ I / O）

14寻址模式

下面处理器包含额外的功能：

MC68HC001/MC68EC000/MC68SEC000

—

静态可选择的8位或16位数据总线

MC68HC000/MC68EC000/MC68HC001/MC68SEC000

—

低功耗

本文件包含有关正在开发中的产品信息。摩托罗拉保留不另行通知变更或终止本产品的权利。

半导体产品信息

在MC68SEC000嵌入式处理器的主要特性包括：

直接替换MC68EC000

—

引脚对引脚兼容的MC68EC000在塑料QFP和TQFP封装

为MC68EC000支持种类繁多的现有的第三方开发工具

MC68SEC000

软件为MC68EC000写上运行的MC68SEC000不变

电源管理

—

低功耗HCMOS技术

静态设计使停止的处理器时钟

3.3V或5V操作

典型0.5μA电流消耗在3.3V睡眠模式

软件实力

—

完全向上对象的代码与其他M68000系列产品兼容

M68000的体系结构，可以有效地汇编代码用C编译器

升级

—

完全向上代码兼容具有更高的性能680X0和68300家庭成员

的ColdFire

代码兼容稍作修改

1. MC68HC000

在MC68HC000的主要优点是减少了电力消耗。该器件消耗更少的功率（由

一个数量级），比NMOS MC68000 。

在MC68HC000是M68000 16 / -32位微处理器体系结构的实现。该

MC68HC000有一个16位的数据总线实现的MC68000 ，并且是向上代码兼容的

MC68010和MC68020 32位实现的体系结构。

1.1 MC68HC001

该MC68HC001提供了一个功能扩展， MC68HC000 HCMOS 16位/ 32位微处理器

添加静态可选择8位或16位数据总线的操作。在MC68HC001是目标代码兼容

与MC68HC000 。你可以不加修改地迁移为MC68HC001编写的代码的任何成员

的M68000家庭。

1.2 MC68EC000

该MC68EC000是一个旨在满足的需求的经济型高性能的嵌入式控制器

成本敏感的嵌入式控制器市场。该HCMOS MC68EC000有一个内部的32位架构，

由静态可选择的8位或16位数据总线的支持。这种结构提供了快速和有效的

可根据高级别满足复杂的应用的要求处理装置

语言。

该MC68EC000是完全面向对象代码与MC68000兼容。您可以迁移的代码编写

MC68EC000不加修饰的M68000家庭的任何成员。

该MC68EC000带来M68000系列的性能水平，以预先与相关的成本水平

8位微处理器。从富M68000指令集MC68EC000利益及其相关的高码

密度与低内存带宽的需求。

M68000用户手册附录

摩托罗拉

1.3 MC68SEC000

该MC68SEC000是专为低功耗应用提供具有成本效益的静态嵌入式处理器。在

除了提供MC68EC000的大量的成本和性能优势，在低功耗模式下

该MC68SEC000的提供的功率消耗和功率管理显著优点。该

在MC68SEC000的典型电流消耗仅为0.5

A的静态待机模式， 15.0毫安正常

工作电压为3.3V 。该MC68SEC000工作在3.3V或5.0V系统。在非常低的功耗

消费，小尺寸封装，静态的实施相结合，在MC68SEC000为低

电源应用，如便携式测量设备，电子游戏机，电池供电的手持式

消费产品。

该HCMOS MC68SEC000的静态结构是一个直接替换MC68EC000 ，它提供了

成本最低的入口点到32位处理。内部32位架构提供了快速，高效的

处理中满足基于高级语言的复杂的应用的要求。

所有广泛使用的现有的第三方开发工具的MC68EC000将直接支持

MC68SEC000 。可以发现，这些工具中的详细描述

高性能嵌入式系统

源目录。

摩托罗拉

M68000用户手册附录

2.0信号描述

变化图3-3 3-2页。

GND

CLK

A23-A0

地址总线

D15-D0

数据总线

处理器

状态

FC0

FC1

FC2

读/写

UDS

LDS

DTACK

MC68SEC000

总线仲裁

控制

异步

总线控制

BERR

系统

控制

RESET

停止

模式

IPL0

IPL1

IPL2

AVEC

打断

控制

图1.输入和输出信号（ MC68EC000和MC68SEC000 ）

2.1数据总线（ D15 - D0 ）

在第3-4页的第3.2节，将“ MC68EC000和MC68HC001使用D7 - D0在8位模式， D15-

D8是不确定的。 “与”使用MC68HC001 ， MC68EC000和MC68SEC000模式引脚，可以

静态地选择8位或16位模式进行数据传输。该MC68EC000 ， MC68SEC000和

MC68HC001使用D7 - D0在8位模式。 D15 - D8是不确定的。 “

2.2总线仲裁控制

在第3-5页的第3.4节，一句“在MC68008和MC68EC000的48引脚版本，无引脚

可用的总线许可的确认信号;该微处理器采用两线总线仲裁

方案。 “应改为”在64引脚MC68EC000和MC68SEC000 ，无引脚可用于总线授权

应答信号。这些微处理器采用两线总线仲裁机制。 “

2.3系统控制

3.6节的第3-7页上的模式小节标题应改为'模式（MODE ）（ MC68HC001 /

68EC000/68SEC000).’’

2.4 MC68SEC000低功耗模式

以下内容添加到第4和第5 ，总线操作。

该MC68SEC000进行了重新设计，以提供充分static-和低功耗操作。本节

描述了所建议的方法用于将MC68SEC000进入低功率模式，以减少

M68000用户手册附录

摩托罗拉

功耗的静态值

同时保持了处理器的内部状态。该

下面描述的低功率模式将被定期地测试所提供的MC68SEC000测试向量的一部分

摩托罗拉。

为了成功地进入低功耗模式下， MC68SEC000首先必须在管理员模式下。一

进入低功率模式的推荐的方法是使用TRAP指令，这将导致

处理器开始异常处理，从而进入超级用户模式。外部电路应

完成陷阱程序中执行以下步骤：

1.外部检测，在写低功率地址。你选择这个地址可以是任何地址

在MC68SEC000的16兆字节地址范围。写低功耗地址可以是

通过轮询A23- A0， R / W，和FC2 - FC0检测。当检测到低功率地址中，R / W为

逻辑低，并且通过功能代码有一个5 （101）上的输出，该处理器被写入到

在管理员模式下的低功耗地址和用户的电路设计应该断言

在图2和图3中示出地址匹配信号。

地址匹配

CPU_CLK

重新开始

RESET

SYSTEM_CLK

图2. 16位数据总线MC68SEC000低功耗电路

地址匹配

CPU_CLK

重新开始

RESET

SYSTEM_CLK

图3. MC68SEC000低功耗电路的8位数据总线

2.执行STOP指令。在图2和图3所示的外部电路，将计数

开始与写入到所述低功耗地址总线周期的数目，将停止所述处理器

在系统时钟的总线周期后的第一个下降沿时钟读取的即时数据

STOP指令。图3中多了一个触发器比图2是因为MC68SEC000中

而在低功耗模式下的初步特定网络连接的阳离子为MC68SEC000的漏电流是独立同< 2

一种用于3.3V和操作

国际直拨< 5

一种用于5.0V操作。

M68000用户手册附录

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消费科技集团

M68000

增编

M68000

用户手册

1997年8月7日

该增编

M68000UM / AD用户手册

修订8 ，提供更正原文为

以及附加信息。这对这款产品文档和其他信息保持的世界

万维网在http://www.motorola.com/68000 。

概观

本手册包括硬件细节和编程信息的MC68HC000 ， MC68HC001的，

该MC68EC000和MC68SEC000 。为了便于阅读，名称M68000主控板时，将使用

参照所有处理器。请参阅M68000PM / AD ，

M68000程序员参考手册

，详细

在MC68000指令集的信息。

四个微处理器都非常相似，彼此都具有以下特点：

16个32位数据和地址寄存器

16M字节的直接寻址范围

程序计数器

6指令类型

对五种主要的数据类型的操作

内存映射输入/输出（ I / O）

14寻址模式

下面处理器包含额外的功能：

MC68HC001/MC68EC000/MC68SEC000

—

静态可选择的8位或16位数据总线

MC68HC000/MC68EC000/MC68HC001/MC68SEC000

—

低功耗

本文件包含有关正在开发中的产品信息。摩托罗拉保留不另行通知变更或终止本产品的权利。

半导体产品信息

在MC68SEC000嵌入式处理器的主要特性包括：

直接替换MC68EC000

—

引脚对引脚兼容的MC68EC000在塑料QFP和TQFP封装

为MC68EC000支持种类繁多的现有的第三方开发工具

MC68SEC000

软件为MC68EC000写上运行的MC68SEC000不变

电源管理

—

低功耗HCMOS技术

静态设计使停止的处理器时钟

3.3V或5V操作

典型0.5μA电流消耗在3.3V睡眠模式

软件实力

—

完全向上对象的代码与其他M68000系列产品兼容

M68000的体系结构，可以有效地汇编代码用C编译器

升级

—

完全向上代码兼容具有更高的性能680X0和68300家庭成员

的ColdFire

代码兼容稍作修改

1. MC68HC000

在MC68HC000的主要优点是减少了电力消耗。该器件消耗更少的功率（由

一个数量级），比NMOS MC68000 。

在MC68HC000是M68000 16 / -32位微处理器体系结构的实现。该

MC68HC000有一个16位的数据总线实现的MC68000 ，并且是向上代码兼容的

MC68010和MC68020 32位实现的体系结构。

1.1 MC68HC001

该MC68HC001提供了一个功能扩展， MC68HC000 HCMOS 16位/ 32位微处理器

添加静态可选择8位或16位数据总线的操作。在MC68HC001是目标代码兼容

与MC68HC000 。你可以不加修改地迁移为MC68HC001编写的代码的任何成员

的M68000家庭。

1.2 MC68EC000

该MC68EC000是一个旨在满足的需求的经济型高性能的嵌入式控制器

成本敏感的嵌入式控制器市场。该HCMOS MC68EC000有一个内部的32位架构，

由静态可选择的8位或16位数据总线的支持。这种结构提供了快速和有效的

可根据高级别满足复杂的应用的要求处理装置

语言。

该MC68EC000是完全面向对象代码与MC68000兼容。您可以迁移的代码编写

MC68EC000不加修饰的M68000家庭的任何成员。

该MC68EC000带来M68000系列的性能水平，以预先与相关的成本水平

8位微处理器。从富M68000指令集MC68EC000利益及其相关的高码

密度与低内存带宽的需求。

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1.3 MC68SEC000

该MC68SEC000是专为低功耗应用提供具有成本效益的静态嵌入式处理器。在

除了提供MC68EC000的大量的成本和性能优势，在低功耗模式下

该MC68SEC000的提供的功率消耗和功率管理显著优点。该

在MC68SEC000的典型电流消耗仅为0.5

A的静态待机模式， 15.0毫安正常

工作电压为3.3V 。该MC68SEC000工作在3.3V或5.0V系统。在非常低的功耗

消费，小尺寸封装，静态的实施相结合，在MC68SEC000为低

电源应用，如便携式测量设备，电子游戏机，电池供电的手持式

消费产品。

该HCMOS MC68SEC000的静态结构是一个直接替换MC68EC000 ，它提供了

成本最低的入口点到32位处理。内部32位架构提供了快速，高效的

处理中满足基于高级语言的复杂的应用的要求。

所有广泛使用的现有的第三方开发工具的MC68EC000将直接支持

MC68SEC000 。可以发现，这些工具中的详细描述

高性能嵌入式系统

源目录。

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M68000用户手册附录

2.0信号描述

变化图3-3 3-2页。

GND

CLK

A23-A0

地址总线

D15-D0

数据总线

处理器

状态

FC0

FC1

FC2

读/写

UDS

LDS

DTACK

MC68SEC000

总线仲裁

控制

异步

总线控制

BERR

系统

控制

RESET

停止

模式

IPL0

IPL1

IPL2

AVEC

打断

控制

图1.输入和输出信号（ MC68EC000和MC68SEC000 ）

2.1数据总线（ D15 - D0 ）

在第3-4页的第3.2节，将“ MC68EC000和MC68HC001使用D7 - D0在8位模式， D15-

D8是不确定的。 “与”使用MC68HC001 ， MC68EC000和MC68SEC000模式引脚，可以

静态地选择8位或16位模式进行数据传输。该MC68EC000 ， MC68SEC000和

MC68HC001使用D7 - D0在8位模式。 D15 - D8是不确定的。 “

2.2总线仲裁控制

在第3-5页的第3.4节，一句“在MC68008和MC68EC000的48引脚版本，无引脚

可用的总线许可的确认信号;该微处理器采用两线总线仲裁

方案。 “应改为”在64引脚MC68EC000和MC68SEC000 ，无引脚可用于总线授权

应答信号。这些微处理器采用两线总线仲裁机制。 “

2.3系统控制

3.6节的第3-7页上的模式小节标题应改为'模式（MODE ）（ MC68HC001 /

68EC000/68SEC000).’’

2.4 MC68SEC000低功耗模式

以下内容添加到第4和第5 ，总线操作。

该MC68SEC000进行了重新设计，以提供充分static-和低功耗操作。本节

描述了所建议的方法用于将MC68SEC000进入低功率模式，以减少

M68000用户手册附录

摩托罗拉

功耗的静态值

同时保持了处理器的内部状态。该

下面描述的低功率模式将被定期地测试所提供的MC68SEC000测试向量的一部分

摩托罗拉。

为了成功地进入低功耗模式下， MC68SEC000首先必须在管理员模式下。一

进入低功率模式的推荐的方法是使用TRAP指令，这将导致

处理器开始异常处理，从而进入超级用户模式。外部电路应

完成陷阱程序中执行以下步骤：

1.外部检测，在写低功率地址。你选择这个地址可以是任何地址

在MC68SEC000的16兆字节地址范围。写低功耗地址可以是

通过轮询A23- A0， R / W，和FC2 - FC0检测。当检测到低功率地址中，R / W为

逻辑低，并且通过功能代码有一个5 （101）上的输出，该处理器被写入到

在管理员模式下的低功耗地址和用户的电路设计应该断言

在图2和图3中示出地址匹配信号。

地址匹配

CPU_CLK

重新开始

RESET

SYSTEM_CLK

图2. 16位数据总线MC68SEC000低功耗电路

地址匹配

CPU_CLK

重新开始

RESET

SYSTEM_CLK

图3. MC68SEC000低功耗电路的8位数据总线

2.执行STOP指令。在图2和图3所示的外部电路，将计数

开始与写入到所述低功耗地址总线周期的数目，将停止所述处理器

在系统时钟的总线周期后的第一个下降沿时钟读取的即时数据

STOP指令。图3中多了一个触发器比图2是因为MC68SEC000中

而在低功耗模式下的初步特定网络连接的阳离子为MC68SEC000的漏电流是独立同< 2

一种用于3.3V和操作

国际直拨< 5

一种用于5.0V操作。

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飞思卡尔半导体公司

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欲了解更多有关该产品，

转到： www.freescale.com

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通过MC68360D

MC68360

产品简介

MC68360四通道集成通信

控制器（ QUICC

)

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介绍

该MC68360四通道集成通信控制器（ QUICC

）是一种多功能单芯片内集成

微处理器，并且可以在多种控制应用中使用的外围组合。它

尤其擅长于沟通活动。该QUICC （发音为“快速” ），可谓一

下一代MC68302与设备运行的各个方面更高的性能，更大的灵活性，

在能力主要扩展和更高的集成度。 "quad"来自这样的事实，有术语

四个串行通信控制器（ SCC的）设备上;然而，实际上有7串行

通道： 4的SCC ，两个串行管理控制器（平滑肌细胞），和一个串行外围接口（SPI）。

QUICC主要特点

下面的列表总结了关键的MC68360 QUICC特点：

CPU32 +处理器（ 4.5 MIPS在25兆赫）

- 32位的CPU32内核（完全兼容的CPU32 ）的版本

- 背景调试模式

- 字节对齐的地址

高达32位的数据总线（动态总线宽度为8位和16位）

多达32根地址线（至少28始终可用）

完全静态设计（ 0-25 MHz的操作）

从模式禁用CPU32 + （允许使用与外部处理器）

- 多QUICCs可以共用一个系统总线（一个主）

- MC68040伴侣模式允许QUICC是一个MC68040伴侣

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存储器（SRAM ），电可编程只读存储器（EPROM ），闪速EPROM ，等。

- 中科院四线，四WE线，一条线OE

- 引导芯片复位时选择用（ 8,16或32位内存选项）

- 特殊功能的MC68040含连拍模式支持

四个通用定时器

- MC68302定时器的超集

- 4个16位定时器或两个32位定时器

- 门模式下可以启用/禁用计数

两个独立的DMA （ IDMAs ）

—

为了达到最快的接送单地址模式

缓冲区链接和自动缓冲模式

自动执行高效填料

32位内部和外部转移

公交车监控

双总线故障监控器

伪中断监控

软件看门狗

周期中断定时器

低功耗停止模式

时钟合成器

断点逻辑提供片上硬件断点

外部的主机可能使用的片上功能，如芯片选择

片上总线仲裁中无开销的内部大师

IEEE 1149.1测试访问端口

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系统集成模块（ SIM60 ）

—

中断

- 七外部IRQ线

- 12端口引脚具有中断功能

16个内部中断源

- 鳞癌之间可编程优先级

- 可编程的最高优先级请求

通信处理器模块（ CPM ）

- RISC控制器

- 许多新的命令（例如，正常停止发送，关闭RxBD ）

- 224缓冲区描述符

- 支持所有串行通道连续模式下发送和接收

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四鳞癌

- 以太网/ IEEE 802.3可选的SCC1 （全10 - Mbps的支持）（仅适用于

MC68EN360)

- HDLC / SDLC

（所有四个通道，可支持2 Mbps的）

- HDLC总线（实现一个基于HDLC的局域网络（LAN））

- 的AppleTalk

- 信令系统＃ 7

- 通用异步收发器（ UART ）

- 同步UART

- 二进制同步通信（ BISYNC ）

- 完全透明（比特流）

- 完全透明（基于具有可选的循环冗余校验帧（ CRC ））

- 现场总线（ RAM微可选）

- 异步HDLC （ RAM微码选项）支持PPP （点对点协议）

- DDCMP

（ RAM微可选）

- V.14 （ RAM微可选）

- X.21 （ RAM微可选）

两个校董会

—

UART

透明

通用电路接口（ GCI ）控制器

可连接到时分复用（ TDM）的频道

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一个SPI

- 对MC68302 SCP超集

- 支持主从模式

- 支持在同一总线上多主机操作

时间时隙分配器

支持双通道TDM

- 每个TDM通道可以T1 ， CEPT ， PCM公路， ISDN基本速率，

ISDN基群速率，用户自定义

- 1-或8位分辨率

- 允许独立的发送和接收路由，帧同步，时钟

- 允许动态变化

- 可以在内部连接到六个串行通道（四鳞癌和

两校董会）

- 并行接口端口

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飞思卡尔半导体公司

QUICC架构概述

的QUICC是32位控制器，其中的其他成员的延伸

飞思卡尔

M68300的家庭。喜欢

该M68300家族的其他成员，在QUICC采用了模块间总线（ IMB ）。（该MC68302是

一个例外，在芯片上有一个M68000总线）国际海事局提供的所有模块的通用接口

M68300系列，它允许

飞思卡尔

通过使用现有的库更快地开发新设备

模块。虽然IMB定义总是包括用于芯片上的32位总线的一个选项，所述的QUICC是

第一个设备来实现此选项。

的QUICC由三个模块： CPU32 +核心， SIM60 ，和CPM 。每个模块

利用32位的IMB 。的MC68360 QUICC框图如图1所示。

SIM卡60

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系统

保护

CPU32+

CORE

周期

定时器

时钟

GENERATION

其他

特点

JTAG

断点

逻辑

DRAM

调节器

和

芯片选择

系统

I / F

IMB （ 32位）

外

公共汽车

接口

CPM

通信处理器

RISC

调节器

两

IDMAs

第十四SERIAL

DMAS

七

串行

频道

2.5-KBYTE

双端口

内存

打断

调节器

FOUR

常规 -

用途

计时器

定时器SLOT

分配器

其他

特点

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取2字长的指令在一个总线周期内，更快速地填充所述内部指令队列。该

CPU32 +核心还可以读取和写入在一个总线周期的32位数据。

虽然CPU32 +指令定时的改善，其指令集是相同的，在CPU32的。它

也将执行整个M68000指令集。它包含相同的背景调试模式（ BDM ）

特点为CPU32 。没有新的编译器，汇编器，或其他软件支持工具需要的话

实现了CPU32 + ;标准CPU32工具都可以使用。

该CPU32 +在25兆赫提供约4.5的MIPS ，基于标准的（接受的）假设是

一个10 MHz的M68000提供1 VAX MIPS 。如果一个应用程序需要更多的性能， CPU32 +可

禁止，允许QUICC的其余部分以作为一个智能外围设备，以更快的处理器。该

QUICC提供称为MC68040协同模式的一种特殊模式，以允许它方便地接口到

该M68040家族的成员。此双芯片解决方案提供了一个22 MIPS的性能，在25兆赫。

该CPU32 +还提供未在CPU32提供自动字节对齐功能。这些

功能允许16位或32位的数据进行读取或写入奇地址。该CPU32 +自动执行

所需的总线周期的数目。

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系统集成模块（ SIM60 ）

将SIM60集成通用特征，将在几乎任何32位处理器系统是有用的。

术语“ SIM60 ”是从QUICC部件号， MC68360而得。该SIM60是一个加强版

上存在的MC68340和MC68330器件SIM40 。

首先，新的功能，诸如DRAM控制器和断点逻辑，已被添加。其次， SIM40

被修改，以支持一个32位的IMB以及一个32位外部系统总线。第三，新的配置，例如

因为从模式和内部访问由外部主机，支持。

虽然QUICC始终是一个32位的内部设备，它可以被配置为具有16位的数据进行操作

总线。无论系统总线大小的选择，支持动态母线调整。总线宽度允许8位，

16位和32位的外设和存储器中的32位的系统总线模式和8位和16位的外围设备存在

而在16位的系统总线模式存在存储器中。

通信处理器模块（ CPM ）

在CPM包含功能，使QUICC在通信和控制应用出类拔萃。这些

特征可以被分为三个子组：

通讯处理器（ CP ）

两个IDMA控制器

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