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EDJ8232E5MB
写时序违规
动机
一般来说，如果时序参数受到侵害时，完全复位/初始化程序，必须启动，以确保
DRAM的正常工作。
然而，期望对某些轻微违规行为，即在DRAM保证不会"hang up"和错误是
限于该特定操作。
对于下面将假设不存在时序违规是写入的写命令本身（包括
ODT等） ，并且它确实满足下面没有提到的所有定时要求。
数据建立和保持违规
应该选通时序要求（TDS ， TDH ）的数据受到侵犯，对任何频闪的边缘与一个关联
写脉冲串，则错误的数据可能会被写入该写入命令发送到存储单元寻址。
在这个例子中（图写时序参数）写爆了相关的选通脉冲边沿与关联
时钟边缘： T5 ， T5.5 ， T6 ， T6.5 ， T7 ， T7.5 ， T8 ， T8.5 。
随后从该位置读取可能导致不可预知的读取数据，但是DRAM将正常工作
否则。
闸门频闪和频闪时钟违规
宜选通时序要求（ tDQSH ， tDQSL ， tWPRE ， tWPST ）或选通时钟时序要求
（ TDSS ， tDSH tDQSS ）被侵犯的任何一个写突发关联闸门边，那么错误的数据可能是
写入到存储器位置寻址违规写命令。随后从该位置读取
可能会导致不可预测的读取数据，但是DRAM将正常工作，否则。
在这个例子中（图写（ BL8 ）写（ BL8 ） OTF）的写突发n中的相关选边关联
与时钟边缘： T4 ， T4.5 ， T5 ， T5.5 ， T6 ， T6.5 ， T7 ， T7.5 ， T8 ， T8.5和T9 。在开始任何时间要求，
这些选通的边缘中的一个结束是T8， T8.5 ，T9 T9.5 ，T10 T10.5 ， T11， T11.5 ，T12， T12.5及T13 。一些
边缘与两个脉冲串相关联。
T0
CK
/ CK
COMMAND *
3
WRIT
NOP
WRIT
T3
T4
T5
T6
T7
T8
T9
T10
T11
T12
T13
T14
NOP
地址*
4
A
B
/ CS
ODTL
WL
tDQSS
TDSS
tDQSL
tWPRE
tDSH
tDQSH
tWPST
BL / 2 + 2 + ODTL
DQS ， / DQS
TDH
TDS
DQ *
2
VIH或VIL
写时序参数
数据表E1813E40 （版本4.0 ）
110
