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AD7440/AD7450A
R
+2.5V
0V
–2.5V
V
IN
R
R
R
5V
2.5V
0V
V
IN +
AD7440/
AD7450A
V
IN-
0.1F
03051-A-039
V
REF
外
V
REF
(2.5V)
来自AD7440 / AD7450A转换结果被提供
作为一个串行数据流的SDATA输出。该位
同步输出对输入SCLK的下降沿。数据
在AD7450A流由四个前导零，随后
由12位首先提供的MSB变换的数据;数据
在AD7440的数据流包括四个前导零，其次是
10位转换数据的后面是两个尾随零，
这也是第一个提供的MSB 。在这两种情况下，输出
编码为二进制补码。
十六个串行时钟周期来执行转换
并从AD7440 / AD7450A访问数据。 CS变低
提供所述第一前导零要由DSP读取或
微控制器。剩余的数据将被同步输出
随后的SCLK的下降沿与所述第二开始
前导零。因此，在串行时钟的第一个时钟下降沿
提供第二前导零。在数据的最终位的
转移是在第16个下降沿有效，已被计时
列于先前（第15次）的下降沿。一旦转换
完整的数据的16个时钟之后被访问
周期，以确保下一次转换之前是很重要
开始，有足够的时间留给满足采集和
安静的时间规范（见时序例1和2 ） 。对
达到1 MSPS与18 MHz的时钟V
DD
= 3 V和5 V ，一
18小时爆进行转换，并留出足够的时间
之前收购和安静的时间下一次转换。
在具有较慢的SCLK的应用程序，它可以是能够读取
在每个SCLK上升沿数据;即，第一个上升沿
在CS下降沿后SCLK将有前导零
提供和第15个SCLK边缘会DB0提供。
图39.应用双极性单端输入到AD7440 / AD7450A
串行接口
图2和图3示出了详细的时序图的
该AD7450A和AD7440分别串行接口。
串行时钟提供转换时钟，并控制
数据从设备转换期间的转移。 CS
启动转换过程和帧的数据传送。
CS的下降沿使轨道和保持到保持模式
并采取公交车出三态。模拟输入进行采样
而转换在此处启动。转换
需要16个SCLK周期来完成。
一次13个SCLK下降沿发生时，轨道和保持
返回到轨道上的下一个SCLK的上升沿，如图在
点B在图2和图3.在第16个SCLK下降沿
在SDATA线返回到三态。如果上升沿
CS发生前16个SCLK已经过去了，转换
终止和SDATA线返回到三态。
CS
10ns
t
2
SCLK
1
2
3
4
t
5
5
t
兑换
B
13
14
C
15
16
t
6
t
8
t
获得
03051-A-040
t
安静
12.5(1/F
SCLK
)
1/THROUGHPUT
图40.串行接口时序示例
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